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EDA365电子论坛网»电子社区 › 研发供应链讨论 › QA检查（免费服务） › 2017年11月20日QA检查报告节选
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2017年11月20日QA检查报告节选

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EDA365QA

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发表于 2017-11-21 09:13 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.SMA头包地. }$ j  {+ p4 H( B

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 楼主| 发表于 2017-11-21 09:15 | 只看该作者
10.+3V3D下面没有连接点不要往下铺
: \% {  E- H5 r& r5 p
$ {( V: B/ P6 N: d" z* o, y7 T

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 楼主| 发表于 2017-11-21 09:14 | 只看该作者
9.板框画得挖空，没有孔，铜要挖出来" O8 y' {' X& r( f

0 g; X3 g( o. v! e

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 楼主| 发表于 2017-11-21 09:14 | 只看该作者
8.没有参考面，孔与铜间距太大
8 O- P5 i+ V. Q! C . L3 @. Z8 L. P" e) w7 X

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2#
 楼主| 发表于 2017-11-21 09:13 | 只看该作者
2.有些高速线走线多次跨分割. Z' l6 ~' k; G
5 \* w2 ~) }; H8 N

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3#
 楼主| 发表于 2017-11-21 09:13 | 只看该作者
3.很多VIA没用上情况- o3 N; {3 g% N6 c
( Q0 Y! e! K2 E% {

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4#
 楼主| 发表于 2017-11-21 09:13 | 只看该作者
4.模拟线包模拟地处理
. D- A2 H8 E6 J2 K8 d 8 S1 b  c1 n& D0 B- T4 n

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5#
 楼主| 发表于 2017-11-21 09:13 | 只看该作者
5.0R电阻大电流走线铺铜
+ G- L/ W/ N0 ?
2 R7 @& |9 j+ C. x6 e

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6#
 楼主| 发表于 2017-11-21 09:14 | 只看该作者
6.原理应该反了
3 n2 ]" g# V5 ~0 [- g 5 _' v% d% \- R( W- `6 i% J4 s

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7#
 楼主| 发表于 2017-11-21 09:14 | 只看该作者
7.地孔太少了8 W4 r& d5 g& _2 W
8 q% [* [7 s$ D' V/ d7 U

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11#
 楼主| 发表于 2017-11-21 09:15 | 只看该作者
11.输入电源地电阻应放一起5 Z$ j8 Q5 v# K" J

$ @7 W$ n/ u7 S+ |( ], f; k8 d

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EDA365QA

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12#
 楼主| 发表于 2017-11-21 09:15 | 只看该作者
12.电阻两端等长4 U, ~1 b6 O2 O; o# B; A9 ~

- C3 ?8 I1 x, V, f( D7 f

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13#
 楼主| 发表于 2017-11-21 09:16 | 只看该作者
13.走线跨分割
3 l1 @! q8 n# r! F# p$ Q2 K
) V/ m' S7 W5 u) p* ~' m

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wuqiongsu

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14#
发表于 2017-11-21 16:22 | 只看该作者
是要铺铜打孔处理么？

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几楼？  详情 回复 发表于 2017-11-22 08:40

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EDA365QA

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15#
 楼主| 发表于 2017-11-22 08:40 | 只看该作者
wuqiongsu 发表于 2017-11-21 16:222 Z8 E% ^, L( M* x, @
是要铺铜打孔处理么？
( H" P8 P9 Y! {$ D
几楼？7 y+ ~; g6 r3 h' y/ a; N! H

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