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EDA365电子论坛网»电子社区 › 研发供应链讨论 › QA检查（免费服务） › 2017年11月18日QA检查报告节选
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2017年11月18日QA检查报告节选

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EDA365QA

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1#
发表于 2017-11-20 10:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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2#
 楼主| 发表于 2017-11-20 10:19 | 只看该作者
2.高压电源地做隔离7 A. ^4 A9 o6 ]) u  J1 A) B
- B. P! K* S. A/ `& M) `

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3#
 楼主| 发表于 2017-11-20 10:19 | 只看该作者
3.SDRAM没等长/ P* F; U$ m% X

$ E: e) L9 e7 ]+ P; n" M5 Z

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4#
 楼主| 发表于 2017-11-20 10:20 | 只看该作者
4.差分走线未按要求走线
" y9 u1 Z, }  o  X8 T- G1 w ) Y0 h( P5 ?$ Y. J/ u

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5#
 楼主| 发表于 2017-11-20 10:20 | 只看该作者
5.USB的ESD器件离接口太远了，布线先过ESD。
/ P9 f! V3 @( X) N  a! _7 G. F' b % _9 z* f7 y+ R; G1 c: q. [

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6#
 楼主| 发表于 2017-11-20 10:20 | 只看该作者
6.有线在RF挖空区过了，参考层不完整7 t! R0 U& p% u
/ ?1 z* r. Z# Q. z% K* b: D9 B

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7#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
7.400V？没有按照安规做间距隔离
* P) [; m8 C; i% l. U4 V
+ |% k% Q& |+ k1 l. n

点评

edapcbsyc
安规应该做多大隔离呢？  详情 回复 发表于 2017-11-20 21:28

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8#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
8.封装库记性与原理图不一致3 ^$ N; @: \- ]; C# \8 e& B

6 U" ]0 s' O1 }: F5 c0 q& m$ W

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EDA365QA

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9#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
9.VIA的隔离盘太大，导致内层多处出现隔断，而且隔断区有走线
' k7 ~* V+ I' \3 ]; |6 w( ]# C" D 5 y' v) n9 _& u: G

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10#
 楼主| 发表于 2017-11-20 10:21 | 只看该作者
10.等长处理
5 Z( O) ]4 m7 s. C4 b  ^
4 {( e; C( b. y+ V- h2 W2 l

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EDA365QA

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11#
 楼主| 发表于 2017-11-20 10:22 | 只看该作者
10-1.等长处理
2 C$ D: }3 Y" t3 F
" F" i8 S% o) i+ t

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edapcbsyc
  • TA的每日心情
    开心
    2025-6-6 15:39

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    [LV.4]偶尔看看III
    12#
    发表于 2017-11-20 21:28 | 只看该作者
    EDA365QA 发表于 2017-11-20 10:21
      n' X; {' X" K  u7.400V？没有按照安规做间距隔离
    & r, Y2 A. x3 i. J! R$ U
    安规应该做多大隔离呢？
    - U6 k% J; E$ e2 B. w7 U, a( `9 ^" o& M, d

    点评

    edapcbsyc
    谢谢解答  发表于 2017-11-22 16:20
    EDA365QA
    可以参考：https://www.eda365.com/thread-146811-1-1.html  详情 回复 发表于 2017-11-21 09:06

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    EDA365QA

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    13#
     楼主| 发表于 2017-11-21 09:06 | 只看该作者
    edapcbsyc 发表于 2017-11-20 21:28) k1 E6 n5 c" L
    安规应该做多大隔离呢？
    % K+ ~6 y* H# c: g9 I# N
    可以参考：https://www.eda365.com/thread-146811-1-1.html
    & L# a6 Y, ^* Z7 |

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