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2017年11月14日QA检查报告节选

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1#
发表于 2017-11-15 09:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.等长未处理
7 \5 I) O& m' x6 ]+ W
, d6 g2 V6 Z3 A9 x

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发表于 2017-12-20 16:43 | 只看该作者
EDA365QA 发表于 2017-11-15 09:53
& I! d  u$ |1 B9 w9 s4 N5.LED极性反了
- ~! p* S+ r. o4 \) Q
做的封装画的二极管的正负极和封封装上标的正极自相矛盾。# p# L8 M' ?" j' f% s# M$ M

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 楼主| 发表于 2017-11-15 09:52 | 只看该作者
3.隔离焊盘太大导致高速差分走线没有完整参考平面
  h! B' Z7 q* @( A8 v/ I, M# n3 K& s / R6 U8 s( N9 w# G

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 楼主| 发表于 2017-11-15 09:59 | 只看该作者
本帖最后由 EDA365QA 于 2017-11-16 09:01 编辑 6 H  W6 A8 \, \" K1 o% K% _# A

4 C; K/ g) c/ v; N! m11.耳机线走8-10mil已经足够了,不要铺铜。4 R( |; V* B' L/ c7 s" Q& n+ R
$ L: D& R; X/ r0 a8 Z. H& Z) f

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2#
 楼主| 发表于 2017-11-15 09:51 | 只看该作者
2.CLK没有按照规范等长
/ b1 {+ I& L5 ?( I( F , c7 x7 }* T0 I

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4#
 楼主| 发表于 2017-11-15 09:53 | 只看该作者
4.原理要求需要过大电流,加宽走线
" C7 ^. q; X( z/ h' V
/ N: k$ w+ v, l) z7 h* N! w; [6 z+ {

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5#
 楼主| 发表于 2017-11-15 09:53 | 只看该作者
5.LED极性反了
- B1 p) t* m; `4 ~ 0 n- h4 R) K$ g  o6 @: t: U- S

点评

做的封装画的二极管的正负极和封封装上标的正极自相矛盾。  详情 回复 发表于 2017-12-20 16:43

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6#
 楼主| 发表于 2017-11-15 09:54 | 只看该作者
6.48V没做安规
7 h0 D; f) \7 ~% I( c: @ - ]7 p* K, J1 e% U

点评

谁能普及一下安规是什么  详情 回复 发表于 2017-11-15 10:06

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7#
 楼主| 发表于 2017-11-15 09:57 | 只看该作者
7.铜皮挖空大,距离板边15-20mil左右即可。
- [0 K4 P6 N; ^- @. ]3 N + J3 u9 m" L: R' }. `

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8#
 楼主| 发表于 2017-11-15 09:57 | 只看该作者
8.高低压做一下隔离处理
+ T: g% [6 J2 ]0 K
7 @, S* b2 N% j% ^

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9#
 楼主| 发表于 2017-11-15 09:58 | 只看该作者
9.隔离器件中间挖空处理5 h- K1 ]- E1 D; l' `: I1 A  N

& w, D4 D* K; D

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10#
 楼主| 发表于 2017-11-15 09:58 | 只看该作者
10.CAN部分走差分
3 c" u: R; g8 K. `" ?* E& j 9 t. }! k9 v: m- T

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12#
 楼主| 发表于 2017-11-15 09:59 | 只看该作者
12.尺寸标注有误差
. v8 S  ]' C* M2 l& N # u0 |' L  d5 I' x. N6 M  _. b
  • TA的每日心情
    开心
    2022-12-16 15:46
  • 签到天数: 2 天

    [LV.1]初来乍到

    13#
    发表于 2017-11-15 10:06 | 只看该作者
    EDA365QA 发表于 2017-11-15 09:54
    % L" J$ E6 J* Y6 I) h6.48V没做安规
    0 G2 ^7 W3 E5 e: D
    谁能普及一下安规是什么6 L3 `: y. r) m: b

    & _: L! g0 B) V9 z0 y$ p

    该用户从未签到

    15#
    发表于 2017-11-17 00:09 | 只看该作者
    这个是什么信号?
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