HDL显示成功导入到PCB，网络却没有变

千秋一叶君 · 发表于 2017-11-9 14:41

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原理图改了，PCB里却没有变，为什么啊？求大神

RickGao · 发表于 2017-11-13 09:52

你HDL画原理图后package有没有成功？如果package没有问题，那么你可以把之前的一些shape或是cline给clp出来，然后把shape或cline删掉再导板子，应该就可以了。

千秋一叶君 · 发表于 2017-11-15 10:01

RickGao 发表于 2017-11-13 09:52
3 U y$ d! ]7 @你HDL画原理图后package有没有成功？如果package没有问题，那么你可以把之前的一些shape或是cline给clp出来 ...

那如果是改版怎么办。。

gleefly · 发表于 2017-11-28 12:42

问题太笼统，可能原因多！！！

xyylucky · 发表于 2018-3-14 12:00

到网表的时候，选项没勾对。

千秋一叶君 · 发表于 2018-10-9 08:31

xyylucky 发表于 2018-3-14 12:00% \1 ~5 G/ l3 w* `7 P6 F
到网表的时候，选项没勾对。

是的，少勾了

lee.cn · 发表于 2018-10-14 18:57

楼主，运行Export physical,出现如下错误 ERROR(SPMHNI-175): Netrev error detected. ERROR(SPMHNI-342): Design flow is Constraint Manager enabled, require pstcmdb.dat and pstcmbc.dat files. 请问如何解决

alan_china888 · 发表于 2019-2-26 23:17

千秋一叶君发表于 2018-10-9 08:316 N _/ Y* I8 Z
是的，少勾了

怎么解决的

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