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HDL显示成功导入到PCB，网络却没有变

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千秋一叶君
  • TA的每日心情
    慵懒
    2025-2-24 15:14

    • 签到天数: 28 天

    [LV.4]偶尔看看III
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    1#
    发表于 2017-11-9 14:41 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    原理图改了，PCB里却没有变，为什么啊？求大神
    " f( G7 C. j6 ?( e

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    RickGao

    该用户从未签到
    2#
    发表于 2017-11-13 09:52 | 只看该作者
    你HDL画原理图后package有没有成功？如果package没有问题，那么你可以把之前的一些shape或是cline给clp出来，然后把shape或cline删掉再导板子，应该就可以了。

    点评

    千秋一叶君
    那如果是改版怎么办。。  详情 回复 发表于 2017-11-15 10:01

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    千秋一叶君
  • TA的每日心情
    慵懒
    2025-2-24 15:14

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    [LV.4]偶尔看看III
    3#
     楼主| 发表于 2017-11-15 10:01 | 只看该作者
    RickGao 发表于 2017-11-13 09:52
      n: v1 }2 W9 y! R. H3 U5 z你HDL画原理图后package有没有成功？如果package没有问题，那么你可以把之前的一些shape或是cline给clp出来 ...
    , u) l' t' m* v$ o1 |8 M+ K: f
    那如果是改版怎么办。。( M8 C7 K) `% Y

    4 J1 @8 D0 ^9 ~# j/ i: }! o

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    gleefly

    该用户从未签到
    4#
    发表于 2017-11-28 12:42 | 只看该作者
    问题太笼统，可能原因多！！！

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    xyylucky

    该用户从未签到
    5#
    发表于 2018-3-14 12:00 | 只看该作者
    到网表的时候，选项没勾对。

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    千秋一叶君
    是的，少勾了  详情 回复 发表于 2018-10-9 08:31

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    千秋一叶君
  • TA的每日心情
    慵懒
    2025-2-24 15:14

    • 签到天数: 28 天

    [LV.4]偶尔看看III
    6#
     楼主| 发表于 2018-10-9 08:31 | 只看该作者
    xyylucky 发表于 2018-3-14 12:00
      W, |: c% q6 b6 V9 {, U到网表的时候，选项没勾对。

    ; O4 w1 C3 n: j. p' [5 g$ Z$ K是的，少勾了
    0 H4 ~$ p: \$ `, K4 a4 g( g% E( ?

    点评

    alan_china888
    怎么解决的  详情 回复 发表于 2019-2-26 23:17

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    lee.cn

    该用户从未签到
    7#
    发表于 2018-10-14 18:57 来自手机 | 只看该作者
    楼主，运行Export physical,出现如下错误 ERROR(SPMHNI-175): Netrev error detected.  ERROR(SPMHNI-342): Design flow is Constraint Manager enabled, require pstcmdb.dat and pstcmbc.dat files. 请问如何解决

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    alan_china888

    该用户从未签到
    8#
    发表于 2019-2-26 23:17 来自手机 | 只看该作者
    千秋一叶君 发表于 2018-10-9 08:31: y2 l& y+ Q! g0 F# Q
    是的，少勾了
    * P  j& V( s! t) p8 o1 g/ A' O
    怎么解决的

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