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EDA365电子论坛网»电子社区 › 研发供应链讨论 › QA检查（免费服务） › 2017年11月5日QA检查报告节选
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2017年11月5日QA检查报告节选

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EDA365QA

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1#
发表于 2017-11-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.匹配电阻应该靠近连接器放置& c: L* m0 @6 y. Q) H
& W' R/ V, ^: ]  p- g2 O

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1023598725

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发表于 2017-11-6 17:44 | 只看该作者
EDA365QA 发表于 2017-11-6 10:16) ^  b! R2 D4 W$ X9 [
6.高速线不哟啊在挖空的隔离焊盘下方走线

% r, f# l" V, L; X你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。4 B  R; O$ ]9 Z  N

点评

ccccindy
我的理解是不能在挖空区域底下过 这样参考平面不完整 落在分隔区 走线应该完全落在参考平面上  详情 回复 发表于 2017-11-28 15:40
剑铮奇迹
不是器件，是差分过孔反盘，穿反盘导致那块参考不连续，这种情况是可以避免的  详情 回复 发表于 2017-11-7 15:58
EDA365QA
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。  详情 回复 发表于 2017-11-7 09:03
Jamie_he2015
应该是，不要在两个过孔之间的挖空区走线  详情 回复 发表于 2017-11-6 18:54

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ccccindy

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发表于 2017-11-28 15:40 | 只看该作者
1023598725 发表于 2017-11-6 17:44" k0 _2 T! e3 c. y1 R
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
! h# l# `! x# l7 C3 h: B9 U
我的理解是不能在挖空区域底下过  这样参考平面不完整  落在分隔区  走线应该完全落在参考平面上; f0 \- S1 R: V$ T

2.jpg (69.57 KB, 下载次数: 4)

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1023598725
谢谢  详情 回复 发表于 2017-12-4 08:28

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fengyu6117
  • TA的每日心情
    怒
    2020-4-16 15:19

    • 签到天数: 5 天

    [LV.2]偶尔看看I
    推荐
    发表于 2017-11-8 09:56 | 只看该作者
    EDA365QA 发表于 2017-11-6 10:15
    0 V' c+ k. S+ D4.CAN没有按照差分走线
    " p& w" H4 ?$ j# B7 A( M2 P! s
    CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。
    , V$ M5 l6 ~, D% ~4 r- E

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    EDA365QA

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    2#
     楼主| 发表于 2017-11-6 10:14 | 只看该作者
    2.电源没有来源1 b4 z: z4 b/ c; d) q

    * j4 S, W3 H$ g" l* Q

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    EDA365QA

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    3#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    3.网格部分应该是表层禁布8 o; u7 ^* q% R0 B( c% o! Q3 o
    ; a, ~% `/ K6 V/ J4 q% V7 P

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    jiangriver
    为什么要禁止布线? 没听懂.  详情 回复 发表于 2017-11-7 19:02

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    EDA365QA

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    4#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    4.CAN没有按照差分走线
    ' d! {. Q8 z" D8 y" ^; Z 6 z% t$ L) L; t- C+ i

    点评

    fengyu6117
    CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。  详情 回复 发表于 2017-11-8 09:56
    LiuTao166462139
    can为什么要走查分呢  详情 回复 发表于 2017-11-7 15:49

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    EDA365QA

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    5#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    5.串口电容加粗处理- F5 u  u5 o1 N" m1 l* O8 [

    % Y- K6 r+ _. r( ?' z& C

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    EDA365QA

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    6#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    本帖最后由 EDA365QA 于 2017-11-7 09:02 编辑 ) w( _8 K( @8 n
    & l4 ]  ]7 K# Y! P+ v9 X, K
    6.高速线不能在挖空的隔离焊盘下方走线
    - A8 s3 x( [. b1 E% c . D- I  \3 o- v% k; ?; k

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    剑铮奇迹
    也不能说不能走线，完全可以把高速线neck模式不走4/4.改成3.9/3.5或者3.5/3.9，满足背钻要求，也可以穿的啊  发表于 2017-11-7 15:54
    1023598725
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。  详情 回复 发表于 2017-11-6 17:44

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    EDA365QA

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    7#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    7.此电源不需铺平面
    2 s  P# C7 ~7 L! |5 w5 M + F: P9 t" s5 R0 W7 r: d. J

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    EDA365QA

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    8#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    8.开路
    7 ?1 t! X" z# u1 D+ @5 z 2 A, B7 d, n; a; ^

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    EDA365QA

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    9#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    9.相邻走线层的走线重叠较多
      B( A7 W2 Q  Q/ j% r " j1 j9 r7 W8 }& |- x

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    10#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    10.485没有走差分3 E- F3 M! n% H- U+ @$ s
    6 ~8 H8 i) Y% @4 H- R$ ?7 G" p

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    Jamie_he2015
  • TA的每日心情
    郁闷
    2024-11-1 15:35

    • 签到天数: 2 天

    [LV.1]初来乍到
    12#
    发表于 2017-11-6 18:54 | 只看该作者
    1023598725 发表于 2017-11-6 17:44
    7 Q' c8 ]9 {8 I你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

    9 f+ u& ?) e3 N* ]4 Q- A1 f应该是，不要在两个过孔之间的挖空区走线

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    1023598725
    谢谢。  详情 回复 发表于 2017-11-7 11:10

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    EDA365QA + 1 热心人！

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    15#
     楼主| 发表于 2017-11-7 09:03 | 只看该作者
    1023598725 发表于 2017-11-6 17:44
    5 z4 \3 e, X( A. B- B4 r6 U- d你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

    8 G4 i% E' Q( Q% Q# Z+ ?0 i& w高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。
    , R4 g( ?9 A/ O* L3 r) L

    点评

    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:10
    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:09

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