2017年9月25日QA检查报告节选

攻城拔寨 · 发表于 2017-9-27 09:32

传道受业解惑

wx_SHOh21dw · 发表于 2017-9-28 22:37

感谢分享

陆大少 · 发表于 2017-10-16 18:18

EDA365QA 发表于 2017-9-26 09:05- R2 D: S2 ?* C: ]9 a
6.光耦前后隔离

bingshuihuo · 发表于 2017-10-17 08:49

EDA365QA 发表于 2017-9-26 09:05( j8 ]7 }/ _. P
4.时钟测试点不要加在末端

时钟测试点应该怎么加？

pcb · 发表于 2017-10-17 13:58

bingshuihuo 发表于 2017-10-17 08:49! x z& s5 U" ~( V0 x
时钟测试点应该怎么加？

测试点应加在布线的路上.

小四月 · 发表于 2017-10-23 13:05

biblejj33 · 发表于 2017-10-24 23:51

fengyu6117 · 发表于 2017-11-1 17:37

南林维京 · 发表于 2018-1-15 15:21

bingshuihuo 发表于 2017-10-17 08:495 N/ L# u6 d' w% ~0 K
时钟测试点应该怎么加？

最好加路径上

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