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2017年8月24日公益PCB评审报告节选

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1#
发表于 2017-8-25 08:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.  参考层不一致.3 j% b+ q  C* M9 j

; c3 w2 \& t  i! S

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 楼主| 发表于 2017-8-25 08:32 | 只看该作者
4.  网口中心抽头加粗,还有一根黄色的没接通开路.
3 L$ O9 B0 \, x+ Y
/ h+ A3 i5 `+ X% b0 W# J& A

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推荐
 楼主| 发表于 2017-8-25 08:36 | 只看该作者
10.  天线隔层参考下有走线,参考面不完整.
! ?: ^% W" B% w3 P+ W- n  T) ~ ( c- d4 p- H1 E3 f# e: z8 @  ?

该用户从未签到

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发表于 2017-8-28 08:37 | 只看该作者
6688hyc 发表于 2017-8-26 09:03. B# g+ ?. b9 j% R
顺便问一下 clock匹配为什么要在末端?

! m" q) |# I1 H( D0 O* W为了不产生反射.
+ ^. R8 `; d. J) {$ k

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2#
 楼主| 发表于 2017-8-25 08:31 | 只看该作者
2.  电容处尽量加VIA./ Y9 e5 Z% k* Y" }& u0 }9 x

2 ?1 t9 r- X0 Q5 O2 N& t8 c% |: j

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3#
 楼主| 发表于 2017-8-25 08:32 | 只看该作者
3.  电源VIA没用上.( z1 R, M; W! E7 ~3 t- t

9 I& w  H6 e/ j

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5#
 楼主| 发表于 2017-8-25 08:33 | 只看该作者
5.  有线跨分割.4 s8 n: `: ^, Z: H

. o6 x% A9 s- X  K9 n$ O

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6#
 楼主| 发表于 2017-8-25 08:33 | 只看该作者
6.  器件没钢网.
8 P4 v0 F" B6 s) d , Q; s& f: R5 ?6 ]

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7#
 楼主| 发表于 2017-8-25 08:34 | 只看该作者
7.  电源要加粗.5 u1 ?0 Y- Q/ y- _, E
% p" Y, v; c; x- W7 h& _6 p

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8#
 楼主| 发表于 2017-8-25 08:34 | 只看该作者
8.  模拟线加粗.
+ }$ I5 p* a9 N3 {* h
% O6 F  E( ~2 r: T

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9#
 楼主| 发表于 2017-8-25 08:35 | 只看该作者
9.  CLK匹配应在末端,差分要多耦合.
5 O7 @1 s' y9 H4 x8 @3 n2 J
7 o  K' m0 u/ Z( R* K- F

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11#
发表于 2017-8-25 08:56 | 只看该作者
支持,感谢分享

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14#
发表于 2017-8-26 09:02 | 只看该作者
给力 我的哥

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15#
发表于 2017-8-26 09:03 | 只看该作者
顺便问一下 clock匹配为什么要在末端?

点评

pcb
为了不产生反射.  详情 回复 发表于 2017-8-28 08:37
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