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2017年7月9日公益PCB评审报告节选

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1#
发表于 2017-7-11 09:48 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.  485信号线没走差分.) V& C& z+ @) j- Y
; u- h" @) s2 ]  `: V' _8 D9 h
  • TA的每日心情
    开心
    2022-6-12 15:08
  • 签到天数: 1 天

    [LV.1]初来乍到

    推荐
    发表于 2017-7-11 11:27 | 只看该作者
    EDA365QA 发表于 2017-7-11 10:00
    , |5 g1 {  U* `( W8 k6 W, _7.  金手指的信号线参考面不完整.
    ! r1 Y$ x0 p: ?- Y1 ~
    我们以前公司处理金手指的时候,也是把金手指下面的内层挖空,防止铜皮外漏导致短路。只是一般只挖空到金手指pad下面,不会像图中挖空那么多。
    & T6 y. G9 G$ e: {# M) y, y

    该用户从未签到

    推荐
    发表于 2017-7-19 16:24 | 只看该作者
    EDA365QA 发表于 2017-7-11 10:02
    3 _! G* l3 [1 y$ B: N' g9.  平面应该铺24V电源地,不要用保护地做参考面.
    . x3 ?( ^4 a( {3 f7 E
    这个应该是原理图的问题吧?少加了tvs保护管?所以都弄成一个地了?
    % e5 _) r7 c( }

    该用户从未签到

    推荐
    发表于 2017-7-13 08:18 | 只看该作者
    EDA365QA 发表于 2017-7-11 10:03/ n5 c+ k  L; f6 d1 d
    10.  运放部分信号线按模拟线加粗.

    & D8 |' {+ P1 M( i- N: N) r4 Q8MIL吗,为什么模块信息线就要8MIL以上
    # S6 B: S8 X2 @2 v) v

    该用户从未签到

    2#
     楼主| 发表于 2017-7-11 09:50 | 只看该作者
    2.  GND布线加粗.
    6 x. f' Z/ H$ @- I8 S( B" ?
    7 ~5 [. b' y! Y9 }! g4 `. w

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    3#
     楼主| 发表于 2017-7-11 09:52 | 只看该作者
    3.  PCI信号线超过要求1500MIL.' ^+ U* b! v( B; {$ j4 a+ x

    , `$ J( G3 C% B8 |% S. o

    该用户从未签到

    4#
     楼主| 发表于 2017-7-11 09:54 | 只看该作者
    4.  隔离器件下不要有铜和线.4 z+ v6 ?6 ~" Y1 P9 d" m

    + d: d5 M' ~, g: C. z) h' ]% ]

    该用户从未签到

    5#
     楼主| 发表于 2017-7-11 09:58 | 只看该作者
    5.  光耦器件前后隔离.
    " O# @6 c- C7 t( w) ~+ F2 j, l

    点评

    光耦器件的前后都是指哪部分,要怎么做到隔离?  详情 回复 发表于 2017-7-11 10:48

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    6#
     楼主| 发表于 2017-7-11 09:59 | 只看该作者
    6.  光耦器件下不要过线.
    * u8 I* W, O) W . J( H8 D7 R4 `9 C

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    7#
     楼主| 发表于 2017-7-11 10:00 | 只看该作者
    7.  金手指的信号线参考面不完整.
    - p* [# w2 C' a4 D& f , a/ z$ m! ~) c

    点评

    我们以前公司处理金手指的时候,也是把金手指下面的内层挖空,防止铜皮外漏导致短路。只是一般只挖空到金手指pad下面,不会像图中挖空那么多。  详情 回复 发表于 2017-7-11 11:27

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    8#
     楼主| 发表于 2017-7-11 10:01 | 只看该作者
    8.  跨分割了.6 u9 B& j! k9 ]8 j& a7 V, M% b
    # t: Z5 x) |+ X. Z

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    9#
     楼主| 发表于 2017-7-11 10:02 | 只看该作者
    9.  平面应该铺24V电源地,不要用保护地做参考面.
    2 A9 [  _6 U' i' _  Y3 V
    ( n+ D  s+ Q9 `+ S, P

    点评

    这个应该是原理图的问题吧?少加了tvs保护管?所以都弄成一个地了?  详情 回复 发表于 2017-7-19 16:24
    这个问题没有看明白???  详情 回复 发表于 2017-7-11 11:32

    该用户从未签到

    10#
     楼主| 发表于 2017-7-11 10:03 | 只看该作者
    10.  运放部分信号线按模拟线加粗.
    8 |& I/ P' B' \3 p! F. z9 \0 @
    ' W) _, ?  e6 p: S- z, d

    点评

    8MIL吗,为什么模块信息线就要8MIL以上  详情 回复 发表于 2017-7-13 08:18
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    2022-6-12 15:08
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    [LV.1]初来乍到

    11#
    发表于 2017-7-11 10:45 | 只看该作者
    EDA365QA 发表于 2017-7-11 09:54
      i! Y2 a5 W) K4.  隔离器件下不要有铜和线.
    / V( e0 C. N" e5 [) C5 i  m! J
    哪些器件属于隔离器件?0 ]. p1 d5 ^' j( p; q

    点评

    光耦 变压器等  发表于 2017-7-11 11:05
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    12#
    发表于 2017-7-11 10:48 | 只看该作者
    EDA365QA 发表于 2017-7-11 09:58
    + U$ z2 b& O  i; o5.  光耦器件前后隔离.
    ! o- W; y6 h$ ~  {7 |4 j0 @, m3 g
    光耦器件的前后都是指哪部分,要怎么做到隔离?
    1 I" M* _% y+ C8 P

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    thanks  详情 回复 发表于 2017-7-11 13:37
    光耦器件一边是输入一边是输出的,输入与输出分开就是了.  发表于 2017-7-11 11:06
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    14#
    发表于 2017-7-11 11:32 | 只看该作者
    EDA365QA 发表于 2017-7-11 10:02
    ! @3 _( W% p% @: n5 ?1 S9.  平面应该铺24V电源地,不要用保护地做参考面.
    # H7 \0 Z, v) I: O9 W) e
    这个问题没有看明白???
    , k% i1 _; U# f* X! H% z2 b) c

    点评

    所以我觉得这个是原理图设计有问题,没加tvs保护管。  详情 回复 发表于 2017-7-19 16:30
    pcb
    保护地与其它网络太近安规过不去.一般都是要隔离保护地.  发表于 2017-7-13 08:44
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    开心
    2022-6-12 15:08
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    [LV.1]初来乍到

    15#
    发表于 2017-7-11 13:37 | 只看该作者
    小千 发表于 2017-7-11 10:489 l1 P8 G- ^; |" A! l
    光耦器件的前后都是指哪部分,要怎么做到隔离?

    % I% k9 l) v, g  V! ^2 dthanks
    * H+ p% @4 A! U: _6 V# [
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