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全志A20的PCB Layout

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764207758

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1#
发表于 2016-11-9 16:01 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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对于全志A20带4颗DDR，PCB Layout的时候使用拓扑还是菊花链呢？谁知道啊、非常感谢

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winboy755

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发表于 2016-12-22 19:56 | 只看该作者
764207758 发表于 2016-12-21 11:21" B4 }0 J4 C1 p% \
请问你的这张图是正面2颗DDR，反面2颗DDR吗？对于6层板你是如何打孔走线的？可以参考下。

# @  M. I- |' t% o3 k& x6层板的电源层太破碎，不过不排除demo板就是6层甚至是4层的（国内厂商在消费产品成本控制上不是一般的牛）9号那老兄发的demo板图，最好参考下，因为出线方式与你的方案一样，有时间的话最好做成近似。可以的话联系下A20的技术支持，最好能拿到demo板PCB文件，在那基础上改（若demo板都是4层的，自己却做成6层，老板会很不高兴的）7 t8 r5 Q  G. I( T( G( J4 p6 M9 f

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winboy755

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发表于 2016-11-11 11:48 | 只看该作者
要星型走线的只是ADDRESS，COMAND、control信号线，它们从CPU出来，兵分两路，一路到一侧背对背的两颗DDR BGA附近，又两兵分两路，到各自BGA，走线等长；另一路到另一侧也是这样；确保CPU到每一DDR引脚走线等长，是为星型+星型，有如树枝分叉上又长分叉。

1.JPG (290.66 KB, 下载次数: 1)

1.JPG

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764207758
请问你的这张图是正面2颗DDR，反面2颗DDR吗？对于6层板你是如何打孔走线的？可以参考下。  详情 回复 发表于 2016-12-21 11:21
764207758
你好，请问线宽，和线间距分别是多少呢？  详情 回复 发表于 2016-11-25 14:58

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winboy755

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发表于 2016-11-25 16:52 | 只看该作者
764207758 发表于 2016-11-25 14:58
- j6 q! h/ v3 D# U8 z你好，请问线宽，和线间距分别是多少呢？
/ c, y4 `1 `% k; d/ D! ]! A
要先根据阻抗、层叠用工具如Polar算好线宽；线间距可以大一些，组内最小为1倍线宽，组间最小2倍线宽；总之高速线间距大一些，平行的走线短一些，减小线间串扰* [& t$ g  _* U

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764207758
6层板（TOP,GND,Signal,Power,GND,Bottom)，组内间距为1W,组间间距为2W，这样可以吧。  详情 回复 发表于 2016-12-21 11:10

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yangjinxing521
  • TA的每日心情
    擦汗
    2025-7-18 15:01

    • 签到天数: 92 天

    [LV.6]常住居民II
    3#
    发表于 2016-11-9 16:38 | 只看该作者
    没有DEMO吗？？？要去

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    764207758
    你是说参考板吗？没有呢  详情 回复 发表于 2016-11-10 14:02

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    hqh885198

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    4#
    发表于 2016-11-9 23:32 来自手机 | 只看该作者
    自己看蕊片要求，

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    764207758
    芯片规格书上只是写了芯片的功能及各管脚的信号等内容，但没有说明LAYOUT的时候4颗DDR如何的走，菊花链或者什么的啊  详情 回复 发表于 2016-11-10 14:10

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    stevedai2005
  • TA的每日心情
    开心
    2019-11-19 15:48

    • 签到天数: 1 天

    [LV.1]初来乍到
    7#
    发表于 2016-11-10 10:51 | 只看该作者
    芯片规格书都有要求！

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    764207758
    芯片规格书上只是写了芯片的功能及各管脚的信号等内容，但没有说明LAYOUT的时候4颗DDR如何的走，菊花链或者什么的啊  详情 回复 发表于 2016-11-10 14:11

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    764207758

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    8#
     楼主| 发表于 2016-11-10 14:02 | 只看该作者
    yangjinxing521 发表于 2016-11-9 16:38% ?% N: s2 n9 {9 `! s
    没有DEMO吗？？？要去

    / s  m' M& O3 h! @5 p你是说参考板吗？没有呢
    $ T* d, `8 X3 K

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    764207758

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    9#
     楼主| 发表于 2016-11-10 14:04 | 只看该作者
    只为一口气 发表于 2016-11-9 16:074 o+ W9 i" `3 c3 U; B/ s
    同求
    3 p5 c4 P+ D- k' {+ e) S, c
    . }* K8 p& _% E+ u& G

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    764207758

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    10#
     楼主| 发表于 2016-11-10 14:10 | 只看该作者
    hqh885198 发表于 2016-11-9 23:32
    * ~8 i% X4 t/ \' m5 e自己看蕊片要求，

    0 y; |  K! d# ^; b6 g! g+ h: L芯片规格书上只是写了芯片的功能及各管脚的信号等内容，但没有说明LAYOUT的时候4颗DDR如何的走，菊花链或者什么的啊$ c' I4 g* c& {5 e7 `$ C* _% _

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    11#
     楼主| 发表于 2016-11-10 14:10 | 只看该作者
    wolf343105 发表于 2016-11-10 10:43- \1 i3 P% k) J7 O5 v# M; k3 b* @
    见图片.

    9 s9 @" T' k; x3 G& c; X只能看到布局，看不出layout啊
    " G8 [7 ~/ x9 ]6 r( c: P

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    12#
     楼主| 发表于 2016-11-10 14:11 | 只看该作者
    stevedai2005 发表于 2016-11-10 10:51
    4 V. V. q5 \& ]# G! E( U9 U芯片规格书都有要求！

    , a( E" s/ u" H% M芯片规格书上只是写了芯片的功能及各管脚的信号等内容，但没有说明LAYOUT的时候4颗DDR如何的走，菊花链或者什么的啊
    * H4 g& [7 t" d2 i. c

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    wolf343105

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    13#
    发表于 2016-11-10 15:24 | 只看该作者
    布件见图片,

    test.jpg (190.63 KB, 下载次数: 6)

    test.jpg

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    764207758
    这是菊花链的模式吗  详情 回复 发表于 2016-11-10 15:42

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    14#
     楼主| 发表于 2016-11-10 15:42 | 只看该作者
    wolf343105 发表于 2016-11-10 15:24" T1 S% P5 D) t+ V: Q4 v% o
    布件见图片,

    : A3 ^9 ?. h. J8 y这是菊花链的模式吗

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    winboy755

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    15#
    发表于 2016-11-11 10:37 | 只看该作者
    4颗DDR的通常正反面各两颗的，拓扑是星型+星型，有公版的就参考下公版吧，那样保险

    点评

    764207758
    正反两面走的都是星型吗？没有公板，可否借鉴下你的板呢？如果不方便的话RRD跟CPU那一部分也可以，非常感谢！  详情 回复 发表于 2016-11-11 11:10

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