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关于ConceptHDL从原理图导PCB时出错问题?请指教

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1#
发表于 2016-8-4 20:08 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我用cadence16.5 conceptHDL设计原理图,完成后道pCB,我使用的Top-down式原理图设计方式
: L) N" y/ x) |* \2 e导PCB时提示“Connectitivity server is unable to  load design. The .xcon file might be missing or incorrect. Your design needs to be netlisted in 16.4 or later version of Design Entry HDL"
; F3 Q1 u8 H8 T' V! u" m/ M7 f7 ~& Q6 u" |
这个是由什么问题导致的?
1 G, O6 H6 P5 l. g& c

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2#
发表于 2016-8-13 16:06 | 只看该作者
原理图版本太低了吧

该用户从未签到

3#
发表于 2017-2-16 16:17 | 只看该作者
楼主,你的问题解决了么?如果解决了,麻烦告知一下方法,谢谢!!!
  K7 ?1 a. D7 q0 \7 |
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