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capture cis做原理图封装

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1#
发表于 2015-11-13 20:42 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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capture cis做原理图封装时,把虚线框拉大之后,放置好部分引脚,后面发现画的太大,缩小那个虚线框时,引脚再也放不进小的虚线框了
1 K6 k- R/ a1 _/ W2 h

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1.png

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2#
发表于 2015-11-14 14:58 | 只看该作者
我试了试,可以的。你肯定见鬼了。

点评

我觉得要是  详情 回复 发表于 2015-11-15 18:49

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3#
 楼主| 发表于 2015-11-15 18:49 | 只看该作者
woaidashui 发表于 2015-11-14 14:58
' E# `# m$ j: k' T. }1 j2 P9 d我试了试,可以的。你肯定见鬼了。
  @8 T6 K  n7 B% u
我觉得要是
  }# |1 N- L6 Z8 I  |

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4#
发表于 2015-11-15 21:05 | 只看该作者
你看看是否可以用忽略格点

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5#
发表于 2015-11-18 13:14 | 只看该作者
多试一试啊 ,问题不是怎样的

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6#
发表于 2015-11-18 17:05 | 只看该作者
把那个框在拉大,拉到引脚那么大,然后再缩小,就可以了。
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