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Signal model 导网表报错,求解答!

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发表于 2015-9-7 14:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问,allegro Design Entry HDL 的原理图导pcb的时候,) x6 k2 i/ k5 A7 S  z
报很多“Signal model 'R0ohms' not found; may effect xnets and electrical constraints.”的错。% c- c9 V/ H8 Y" M: C5 v2 `! d
请问有没有方法不报错,或者不导模型的信息进pcb。' ?: `+ y* q2 z- @" \: `

( O! N7 h$ `- ?+ K9 _- o. F请知道的大神们解答我一下啦^_^6 K7 h6 R  F- V5 K

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发表于 2015-10-11 09:35 | 只看该作者
START_ECSET_MODELS: D% a+ t7 N8 j' p
retain_existing_xnets_and_diffpairs 'ON'+ }: G% H9 L8 o4 }2 h: m+ T% G
END_ECSET_MODELS( j( g- b/ T) J, u" C

  c/ P, Q# s5 \0 d! ^工程文件cpm最后加上这个

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