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Signal model 导网表报错,求解答!

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发表于 2015-9-7 14:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问,allegro Design Entry HDL 的原理图导pcb的时候,
1 R% d4 ^9 i0 X( E2 s$ V$ J' E报很多“Signal model 'R0ohms' not found; may effect xnets and electrical constraints.”的错。6 L, k3 v7 G, k
请问有没有方法不报错,或者不导模型的信息进pcb。
0 \2 A( Q0 {$ Z* P
2 l: H  G: h  H& J4 {; r请知道的大神们解答我一下啦^_^
$ T$ u5 q2 M4 H/ C6 U# [# d9 M

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发表于 2015-10-11 09:35 | 只看该作者
START_ECSET_MODELS7 F& P2 s& z7 y* W. S5 Z
retain_existing_xnets_and_diffpairs 'ON'
7 F, X& \( x9 P2 x8 u6 l" lEND_ECSET_MODELS4 ^8 g8 h* D) K; o
5 u  |+ J  v( o# X! I
工程文件cpm最后加上这个

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