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关与DDR走线的技巧

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发表于 2014-11-9 16:08 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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ddr走线的阻抗设计,在pads中有什么好的技巧
  x4 `9 D' i! O2 A8 d. p

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发表于 2015-4-23 09:32 | 只看该作者
对于DDR等长这一块,DDR芯片到CPU的距离可以随意放置吗,没有什么限制吗?
0 K- S6 K( o( C2 R9 L-- 分两种情况:有排阻和没排阻
2 k" a! B' {  n/ M4 G% q; ~+ z$ S' d
1,有排阻,排阻离CPU 3mm,排阻另一头离DDR 3mm* a1 i) W+ w9 U
1 U& S0 ]1 S, |1 ?: u! N, J
2, 没排阻,DDR离CPU 5~6mm
; x5 p" l: f2 Z: x0 E, s9 d% A
' p3 H, t; h1 K& f& E3 D0 D6 y6 M6 J0 W+ T  \- ]9 N
DDR走线在6层板或者8层板中该怎么分配走线呢?6 h; q( u( [- f. Z3 `+ x

4 O+ }5 U- V: z0 I# V3 e请提供层叠。
% L5 F) K0 l# s/ g, [. o, C" V- x4 M
# h$ b1 f+ k  j. ^$ g: r
DDR走线不是需要参考平面吗?3 [6 c9 E& s3 |4 F1 H/ e2 Z

; o- h3 D' _4 I( U& ]. _2 E需要# ^1 L7 Z" D( e) }

7 c& E, V7 J3 H: W4层板中又该怎么规划设计呢?
3 e! E& v  l6 U* A2 x2 D! B
' a; ?4 d2 p8 r/ o& o% M& r6 J0 P& s& o/ h
请提供实例文件。$ e6 f! d# u' O- o

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 楼主| 发表于 2015-4-17 21:19 | 只看该作者
对于DDR等长这一块,DDR芯片到CPU的距离可以随意放置吗,没有什么限制吗?DDR走线在6层板或者8层板中该怎么分配走线呢?DDR走线不是需要参考平面吗?4层板中又该怎么规划设计呢?
' Y, V  v/ c5 F( ^

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发表于 2015-4-23 09:33 | 只看该作者
w446727704 发表于 2015-4-18 23:287 l( ~: o9 e, Q1 O0 G4 Z8 f
BGA扇出和互联走线时有何技巧可找

8 ]) p1 F% k# E* V4 m7 r利用栅格。合理利用布线通道。首先要明白布线通道主要存在于哪些地方。) e" a; K5 f# |$ P9 w

* s5 J( h1 [* b5 n6 r5 b, x
- |# A/ k& S, P0 k6 v

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2#
发表于 2014-11-10 14:54 | 只看该作者
请参阅《PADS9.5实战攻略与高速PCB设计》的15-17章节关于DDR2,DDR3的设计方法和原则。

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3#
发表于 2014-11-13 19:18 | 只看该作者
请购买林教授的书,里面的章节有讲到DDR设计技巧

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4#
 楼主| 发表于 2015-4-13 12:53 | 只看该作者
谢谢大家回复,书已经买了,但是对DDR的原理部分还是不是很了解

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5#
发表于 2015-4-13 13:25 | 只看该作者
哦,你对哪一块的原理不清楚呢?

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7#
 楼主| 发表于 2015-4-18 23:28 | 只看该作者
BGA扇出和互联走线时有何技巧可找

点评

利用栅格。合理利用布线通道。首先要明白布线通道主要存在于哪些地方。  详情 回复 发表于 2015-4-23 09:33

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8#
发表于 2015-4-20 15:29 | 只看该作者
书上没说吗?

点评

书上已经分享了设计方法和技巧。 更多末尽的方法或原理,我们可以在论坛或书籍专区交流。  详情 回复 发表于 2015-4-23 09:34

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9#
 楼主| 发表于 2015-4-22 20:19 | 只看该作者
书上没有写这些细节问题

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13#
发表于 2015-4-23 09:34 | 只看该作者
liangjiatian 发表于 2015-4-20 15:29% G$ k# k: }# L
书上没说吗?
  D) g1 p' U# U# r9 U9 k
书上已经分享了设计方法和技巧。
, \( W% {! x) e4 H1 S. o0 b8 g! R3 j' V% ?, l5 _: Y4 O( l
更多末尽的方法或原理,我们可以在论坛或书籍专区交流。
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