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layout走线的 阻抗 设计

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1#
发表于 2013-7-3 09:46 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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我使用polar si9000进行阻抗计算,使用的是Coated Microshtrip 1B,根据要得到的阻抗来计算线宽,看到里面要求填入的数据如图,不知道这些值一般工艺下都是多少啊,请大神指导。PS 我们的PCB厂家跟我讲线高0.9qz,绝缘材料是PP,不懂什么意思求赐教

单线阻抗计算.jpg (85.35 KB, 下载次数: 12)

单线阻抗计算.jpg
  • TA的每日心情

    2019-11-19 16:12
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    [LV.1]初来乍到

    8#
    发表于 2013-7-4 10:43 | 只看该作者
    bobzhu 发表于 2013-7-4 10:28
    $ p2 W$ J; R/ @如果线的粗细影响不大,板厚的工艺一般变动也不大,那靠什么来得到我想得到的阻抗呢?求赐教
    & z+ B3 [1 a5 J7 y
    板厚确定,板材确定,介电常数确定,铜厚影响不是很大,阻抗看你要求多少了,一般大多数都是50欧姆,给这些数值相应的输入,阻抗线的线宽就出来了。
    5 R1 q0 g" \* E' S7 R* J你在算出来的线宽基础上+/-几个mil,对阻抗的影响不是很大的。

    该用户从未签到

    7#
     楼主| 发表于 2013-7-4 10:28 | 只看该作者
    xiaoyangren 发表于 2013-7-3 14:54
    $ C0 U: P' a' B3 x+ C4 }你看下图:* a4 e9 [( ?' v9 z
    线宽粗细一点点,对阻抗的影响不是很大的。我算阻抗都是按这些裸铜算的,阻焊厚度没怎么考虑的 ...
    * z0 c$ l) }" @. L
    如果线的粗细影响不大,板厚的工艺一般变动也不大,那靠什么来得到我想得到的阻抗呢?求赐教

    该用户从未签到

    6#
    发表于 2013-7-3 19:53 | 只看该作者
    hlj4222 发表于 2013-7-3 19:18
    + T/ @: R9 A  M1 \: N0 a线高就是铜箔厚度,1 j, M3 W# ?; V
    pp就是铜箔之间的胶,也就是绝缘介质,想一下多层的堆叠结构就知道了。
    & F3 ]0 b1 o5 `( p9 l$ [+ k: @) @7 K7 d顺便问下单面 ...
    4 E! q% j9 ?( ]2 j
    单面板可以用共面模型算阻抗 。和包地是一码事。{:soso_e120:}

    该用户从未签到

    5#
    发表于 2013-7-3 19:18 | 只看该作者
    线高就是铜箔厚度,2 V8 E2 Z( r. K0 Y* Z
    pp就是铜箔之间的胶,也就是绝缘介质,想一下多层的堆叠结构就知道了。; c8 w/ C) t6 k- Y* t3 m
    顺便问下单面板有要算阻抗的吗?
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    4#
    发表于 2013-7-3 14:54 | 只看该作者
    你看下图:  |: h& X0 X# k; n, ^4 j
    线宽粗细一点点,对阻抗的影响不是很大的。我算阻抗都是按这些裸铜算的,阻焊厚度没怎么考虑的。

    213213.jpg (143.47 KB, 下载次数: 13)

    213213.jpg

    该用户从未签到

    3#
    发表于 2013-7-3 13:43 | 只看该作者
    在下方切换一下。换成Lossless Calculation

    该用户从未签到

    2#
    发表于 2013-7-3 10:33 | 只看该作者
    我也不懂,进来学习!
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