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[Ansys仿真] 封装电路板Q3D参数提取电容过大怎么办

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 楼主| 发表于 2024-8-3 15:55 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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两根走线都是4000um左右,线宽线距都是30um。
. X, K4 w, G. T9 \% x一个是直线,两边都是包地,旁边还额外打了2个对地孔, 第二层跨了5个电源和地平面。- ]+ Z9 W" j2 b5 m' _
一个是弧线,两边也是包地,旁边没有对地孔,  第二层跨了3个电源和地平面。7 m8 D$ @4 r8 H- C6 N

$ \8 y) y8 z, n2 {8 L8 H" Z# X* A2 ]  Q9 V5 k
为什么仿真出来直线的电容 0.8(自容)大于弧线 0.6 (单位好像是pF)?  怎么减小电容?
( w) \& Q. s* h; a/ m% n; W' n& _4 M" O+ h: q1 n% T( u* l" \
  [8 f* T/ @7 V4 v* U

该用户从未签到

1#
发表于 2024-8-6 10:54 | 只看该作者
通过综合考虑布局、材料、屏蔽技术和仿真优化,可以解决封装电路板Q3D参数提取中电容过大的问题
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