像DDR2_JESD79-2F标准里面的一些测试指标在仿真工具里面如何体现？

mengzhuhao

像DDR2_JESD79-2F标准里面的一些测试指标在仿真工具里面如何体现？
9 N& E! @: ~! y+ i  R* y; c' L/ l' a
6 S( g4 y6 B8 z0 d! q0 T3 G+ A例如涉及到的一些DQS/DQ时序关系分析，时钟jitter，上升沿/下降沿速率转换等等
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, S! k$ U4 o8 P% @! b& }; k$ _在类似ADS，ANSOFT DESIGER是如何处理的呢？
6 V% D) ]* W9 p2 I, K& c
在这方面有经验的朋友可以谈谈
3 c4 @5 s6 F* k

qingdalj

有些软件直接提供需要输入的时序参数，只要搞明白它需要什么，输入后仿真就好了

了阔兲空

了解啦，谢谢

Coziness_yang

像DDR2_JESD79-2F标准里面的一些测试指标在仿真工具里面如何体现？


例如涉及到的一些DQS/DQ时序关系分析，时钟jitter，上升沿/下降沿速率转换等等
对于DQS与DQ之间的时序关系，标准里面规定了建立时间和保持时间，而在DDR3里面这些时序关系可以进行一定的调整，所以不需要太考虑这个时序关系。而对于时钟的Jitte，看你需要仿真哪些Jitter，时钟主要考虑Duty cycle的问题，因为这个最好仿真得到。

terry_yung

时序测量

chenlinfeng88

yejialu 发表于 2012-5-30 10:02
, ^5 e, V# T8 ?我用Allegro 做的DDR2 的SI和时序仿真。
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3 I) p. u7 F) ^2 N4 v5 m: Y2 o不懂啊。。。好多东西需要学习

yejialu

我用Allegro 做的DDR2 的SI和时序仿真。
  Y( r: X9 G- ?( w7 ~  O8 w1，DQS/DQ时序关系分析。加test load 在软件中直接测量，算PCB skew ,计算时序裕量。
( v( v1 h! w; T) C0 Q& }2，时钟jitter。仿真中没考量jitter的影响。 这是个复杂的问题， 不好把jitter加入进去。
3，上升沿/下降沿速率转换。查JEDEC中的derating 表格，在1步中计算出的时序裕量中减去这个值。得到更接近实际的时序裕量值。

mengzhuhao

那些工具在模板与一致性测试比较好呢？