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发表于 2022-8-15 15:25 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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请教一下反相器输入和输出之间串电阻是什么用法?输入信号是100MHz正弦波。# b  }/ Q( ~4 J9 D

# w) o. N: e0 w8 j8 p7 i3 X

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咱昨晚帶了啤酒去問師父,這老頭若講錯了,你可別怪我!>_<!!!  发表于 2022-8-19 10:40

该用户从未签到

推荐
发表于 2022-8-19 07:56 | 只看该作者
本帖最后由 超級狗 于 2022-8-19 10:36 编辑
6 t! P! j9 _9 d* T$ a: l8 W7 E& ^- \
邏輯閘Logic Gate)輸入和輸出端間接了反饋電阻Feedback Resistor),能為邏輯閘Logic Gate)特性以外多提供一些輸入電壓的遲滯Hysteresis)效果。
  o6 g- P9 J$ O3 ?+ k
! }+ A/ c1 I) F3 i4 C2 ^. @# l
多些遲滯Hysteresis)能減少訊號毛刺Glitch)的問題這種作法施密特觸發Schmitt Triger邏輯閘Logic Gate)不普及的年代有不少人會這樣設計施密特觸發Schmitt Triger邏輯閘Logic Gate)普及之後,如果有人嫌遲滯Hysteresis)效果不夠時,偶爾還是見到有人這樣做

2 [; n8 `, @, w這電路在一般情況下不會有問題
,但遲滯Hysteresis)的反面效果就是會讓反應變慢在高速應用是不建議這樣做的

- h1 K2 ~; s$ l# c7 H

" f) V" }* M' q5 s$ ~4 ?8 N

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实力太雄厚了,受教了  详情 回复 发表于 2022-8-19 08:51
  • TA的每日心情
    开心
    2021-2-7 15:40
  • 签到天数: 1 天

    [LV.1]初来乍到

    7#
    发表于 2022-8-19 08:51 | 只看该作者
    超級狗 发表于 2022-8-19 07:56+ [2 c# [* k) r$ b/ ~% [
    邏輯閘(Logic Gate)輸入和輸出端間接了反饋電阻(Feedback Resistor),能為邏輯閘(Logic Gate)特性以 ...
    + _- O+ N1 N0 B5 q1 h! `# N0 m
    实力太雄厚了,受教了

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    怎知咱的師傅不是胡謅的???>_<|||  发表于 2022-8-19 10:22
  • TA的每日心情
    开心
    2024-4-29 15:07
  • 签到天数: 466 天

    [LV.9]以坛为家II

    6#
    发表于 2022-8-19 08:09 | 只看该作者
    :hug::hug::hug::hug:
  • TA的每日心情
    开心
    2022-1-29 15:04
  • 签到天数: 1 天

    [LV.1]初来乍到

    4#
    发表于 2022-8-15 16:20 | 只看该作者
    应该是负反馈吧,运放的输出端接到反向输入端一般是负反馈!比较常用。
  • TA的每日心情
    开心
    2022-1-24 15:10
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
    发表于 2022-8-15 16:18 | 只看该作者
    反相器输出端与输入端之间联接电阻,构成负反馈放大器。该电路增益大致上等于R3除以信号源内阻。
    1 P% U% F: J( q7 l6 n5 l' ]! a9 [该电路是四个反相器并联输出,可能是为了增加输出电流。但这样做有一定危险:各反相器参数有差异,A1A2两输入端电压相同,Y1Y2可能一个输出高电平一个输出低电平,Y1Y2又联接在一起,此时会造成两个反相器内部输出电路短路,使管子功耗大为增加。最好不要这样使用。
  • TA的每日心情
    开心
    2022-1-29 15:04
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
    发表于 2022-8-15 16:18 | 只看该作者
    把电原理图画出来吧。谁能知道你的 “输入和输出之间串电阻” 串到哪里去了?
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