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Autosilk top, Silkscreen top 和Assembly top三个什么区别

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1#
发表于 2011-10-2 01:50 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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Autosilk top, Silkscreen top 和Assembly top三个什么区别
& Z& y/ l5 Y* o在做出来的电路板上, 在这些层上的字符是不是都会显示出来,

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2#
发表于 2011-10-2 06:58 | 只看该作者
Silkscreen top 会的;$ y0 `( s9 y. S* D  x( Q
Assembly top 不会,设计的时候辅助看而已;
1 C' f. M3 j1 D% J  |+ h/ zAutosilk top我好像没用过,不知道在哪里(我现在的电脑没有allegro)

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3#
 楼主| 发表于 2011-10-4 14:49 | 只看该作者
谢谢 Sebank 回复, 我是在画板子的过程中, 看到板子上这三个层的字符都显示, 所以才这么问的, 怕做出的板子来, 显示的字符太乱, 在我的电脑中:
2 z: D, h5 u$ T4 u/ RD:/Cadence/SPB_16.3/doc/algrostart/chap2.html 中的 表 Table 2-1  Classes and Subclasses% q$ \' v2 |* S) u! Z( {
可以找到 Autosilk_top , 6 r' d9 N% U! _0 U+ b
Group                          class                                  subclass
" H  T( }4 V$ t% G4 K  V* R Manufacturing             Manufacturing                      ... Autosilk_top, Autosilk_bottom ....
; W& I- r1 F* m( w
9 }9 d/ z0 T9 W; U9 ]继续寻求高手的指点与解惑, 万分感谢! ' ~$ }  V; L, j! W

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4#
发表于 2011-10-4 16:20 | 只看该作者
这个只要在光绘上只出一个就可以,丝印可以出Silkscreen也可以出Assembly,看你喜欢或公司规定。Autosilk是Manufacture菜单下出的,一般我出光绘都是出Autosilk,其实就是先整合下丝印层,到时候出光绘时比较方便。

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5#
发表于 2011-10-5 19:56 | 只看该作者
其实都可以的, 要看你的需

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6#
发表于 2011-10-6 14:51 | 只看该作者
看你们公司出光绘的习惯吧,你设置哪项需要就可以了,一般情况下是和2楼说的一样

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7#
发表于 2011-10-7 09:52 | 只看该作者
Autosilk top, Silkscreen top 和Assembly top
/ K7 J# n. ~/ I( G0 e" P. y+ CAutosilk top:最后出gerber的时候,自动生成的丝印层。会自动调整丝印位置,以及碰到阻焊开窗的地方,丝印会自动消失,避免露锡的地方涂上丝印(一般画丝印层的时候,焊盘上不会画上丝印,所以过孔焊盘上有丝印,也不会有什么影响。),所以我个人一般很少用到Autosilk top层,毕竟最后出丝印的时候,都需要调整位置。我一般直接用Silkscreen top。
' `# U) B. s! j6 \Silkscreen top:建库的时候,ref des放置的层,及PCB生产时,刷到板卡上的字符、器件外框或者公司LOGO等放置的层。我出gerber,一般直接出这一层。
1 o. h1 {. Z. V: v* lAssembly top:安装丝印层。因为有些公司需要出安装图,有些为了手工焊接,喜欢把字符丝印放置在器件内部,比如电阻位号,喜欢把它的丝印放置在电阻符号外框的中间位置。比如说电阻值等,想打印出来放置在安装图纸的电阻相应位置。这时我们才会用到安装丝印层。平时可以不用,或者平时只用Silkscreen top。
5 B4 Y, q3 y, i" i5 ^& g0 A所以这三个丝印层各有各的作用。总体来说,cadence软件定义的这些层使用很灵活,每个人用法可能稍微有差异,都是没关系的,只要实现你的使用目的即可。$ J9 R+ K0 |$ }2 i& `: S* D9 l. L

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8#
 楼主| 发表于 2011-10-7 14:27 | 只看该作者
谢谢各位高手的指点, 我好像明白了, 7 P: W6 d$ Z$ Y  ~0 N
最后在电路板上显示与否, 要看最后出 光绘文件时确定, ; Y! W: v+ s! a
而在许多的 像 $ y$ ?9 _1 o4 U6 B
board geometry -> silkscreen top/bottom+ S3 t; T, e" U% K7 S6 e
package geometry -> silkscreen top/bottom& k5 B9 H0 L. Y8 w+ [
component -> silkscreen top/bottom
  ^( v9 z, F; `' `* d$ ~# @这些个丝印, 最后显示的是哪个, 也是最后出光绘文件时来确定的,
) {& M2 U7 c7 D+ t6 B6 W各位高手, 我这样理解对吗? 谢谢大家的指点, 我是刚学习 allegro, 4 N1 h5 r7 f% l2 v
完全是自学, 很多地方理解难免有偏差!
6 z7 @7 r* }# T

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9#
 楼主| 发表于 2011-10-7 14:31 | 只看该作者
另外, 在菜单 Manufacture -> DFx check(legacy),
0 u( P* @0 O+ n: JDesign for assembly 这个, 有熟悉的吗? 能不能给说一下, 这个检查
6 l* H2 b2 K- o有多大必要 ?

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10#
 楼主| 发表于 2011-10-7 14:31 | 只看该作者
我使用的 Cadence 版本是 16.3 的,
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