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Cortex-M3里GPIO的概念

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发表于 2022-1-10 13:50 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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最近在看数据手册的时候,发现在Cortex-M3里,对于GPIO的配置种类有8种之多:* N2 H6 K5 W9 ]  a4 Q8 J: s
(1)GPIO_Mode_AIN 模拟输入
. S, e( m. o; z. ?6 G% T1 {(2)GPIO_Mode_IN_FLOAtiNG 浮空输入
$ h6 v, i9 e3 g) X1 c' \(3)GPIO_Mode_IPD 下拉输入$ o& p7 c  h8 E2 T6 G$ I" L
(4)GPIO_Mode_IPU 上拉输入
0 d' Q* M( O' P2 L3 d) K( h) l# C(5)GPIO_Mode_Out_OD 开漏输出3 ~) K2 k; V. O, T1 b+ f
(6)GPIO_Mode_Out_PP 推挽输出! o; S, N( y, H: O5 ^& B
(7)GPIO_Mode_AF_OD 复用开漏输出
; \4 p# x  g5 r, T1 [* \(8)GPIO_Mode_AF_PP 复用推挽输出1 x/ P! Z+ _; O. @; _8 {
对于刚入门的新手,我想这几个概念是必须得搞清楚的,平时接触的最多的也就是推挽输出、开漏输出、上拉输入这三种,但一直未曾对这些做过归纳。因此,在这里做一个总结:
; P- X) n# S0 v! K( t( q* X2 E5 f; J5 \$ ~0 g' x" [' K
一、推挽输出:可以输出高、低电平,连接数字器件;推挽结构一般是指两个三极管分别受两个互补信号的控制,总是在一个三极管导通的时候另一个截止。高低电平由IC的电源决定。9 U0 O$ M; Y* P, U6 m! B" c
推挽电路是两个参数相同的三极管或MOSFET,以推挽方式存在于电路中,各负责正负半周的波形放大任务,电路工作时,两只对称的功率开关管每次只有一个导通,所以导通损耗小、效率高。输出既可以向负载灌电流,也可以从负载抽取电流。推拉式输出级既提高电路的负载能力,又提高开关速度。% G2 J% V7 O4 `# h3 j

: h! x  A, F. r' r% \; r二、开漏输出:输出端相当于三极管的集电极,要得到高电平状态需要上拉电阻才行。适合于做电流型的驱动,其吸收电流的能力相对强(一般20mA以内)。开漏形式的电路有以下几个特点:
6 c( h: a3 G1 D# Q& `, f1、利用外部电路的驱动能力,减少IC内部的驱动。当IC内部MOSFET导通时,驱动电流是从外部的VCC流经上拉电阻、MOSFET到GND。IC内部仅需很小的栅极驱动电流。, Q: D- O; a4 D% ?
2、一般来说,开漏是用来连接不同电平的器件,匹配电平用的,因为开漏引脚不连接外部的上拉电阻时,只能输出低电平,如果需要同时具备输出高电平的功能,则需要接上拉电阻,很好的一个优点是通过改变上拉电源的电压,便可以改变传输电平。比如加上上拉电阻就可以提供TTL/CMOS电平输出等。(上拉电阻的阻值决定了逻辑电平转换的速度。阻值越大,速度越低功耗越小,所以负载电阻的选择要兼顾功耗和速度。)
: R- N- |5 D4 D" I: g3、开漏输出提供了灵活的输出方式,但是也有其弱点,就是带来上升沿的延时。因为上升沿是通过外接上拉无源电阻对负载充电,所以当电阻选择小时延时就小,但功耗大;反之延时大功耗小。所以如果对延时有要求,则建议用下降沿输出。
$ O7 i& h( b9 X! g1 X+ {5 W6 n/ A4、可以将多个开漏输出连接到一条线上。通过一只上拉电阻,在不增加任何器件的情况下,形成“与逻辑”关系,即“线与”。可以简单的理解为:在所有引脚连在一起时,外接一上拉电阻,如果有一个引脚输出为逻辑0,相当于接地,与之并联的回路“相当于被一根导线短路”,所以外电路逻辑电平便为0,只有都为高电平时,与的结果才为逻辑1。# ?" Q4 a9 }# A
关于推挽输出和开漏输出,最后用一幅最简单的图形来概括:该图中左边的便是推挽输出模式,其中比较器输出高电平时下面的PNP三极管截止,而上面NPN三极管导通,输出电平VS ;当比较器输出低电平时则恰恰相反,PNP三极管导通,输出和地相连,为低电平。右边的则可以理解为开漏输出形式,需要接上拉。
6 ?- {0 D$ S0 l% M

+ v9 P8 N3 G" u& e  _  ?, H3 O
& Y: \9 W8 [3 ?( k7 m三、浮空输入:对于浮空输入,一直没找到很权威的解释,只好从以下图中去理解了
5 o) _& D$ B6 Q5 U: K& ~
由于浮空输入一般多用于外部按键输入,结合图上的输入部分电路,我理解为浮空输入状态下,IO的电平状态是不确定的,完全由外部输入决定,如果在该引脚悬空的情况下,读取该端口的电平是不确定的。
; v1 i% F/ w: F- Z
4 z& f5 J' C6 E. {; s/ P四、上拉输入/下拉输入/模拟输入:这几个概念很好理解,从字面便能轻易读懂。" ^& l8 {  K6 M; z
) I) ^+ A8 w2 y7 m. C0 o, h. n: R
五、复用开漏输出、复用推挽输出:可以理解为GPIO口被用作第二功能时的配置情况(即并非作为通用IO口使用)
# _8 L( u  ]2 M
7 V' S1 }' ?  a4 t六、总结在STM32中选用IO模式9 c( f& l& g) a# G. f: u; p' b
1、浮空输入GPIO_IN_FLOATING ——浮空输入,可以做KEY识别,RX1
3 |. _- Y; j$ C2、带上拉输入GPIO_IPU——IO内部上拉电阻输入
* Y! `- C* m, S5 Q# i2 v4 D5 i& l3、带下拉输入GPIO_IPD—— IO内部下拉电阻输入
7 K) O' T5 \# V4、模拟输入GPIO_AIN ——应用ADC模拟输入,或者低功耗下省电
% q) f1 G7 H0 }5、开漏输出GPIO_OUT_OD ——IO输出0接GND,IO输出1,悬空,需要外接上拉电阻,才能实现输出高电平。当输出为1时,IO口的状态由上拉电阻拉高电平,但由于是开漏输出模式,这样IO口也就可以由外部电路改变为低电平或不变。可以读IO输入电平变化,实现C51的IO双向功能
% D( e4 Y: M% ]8 K$ @6、推挽输出GPIO_OUT_PP ——IO输出0-接GND, IO输出1 -接VCC,读输入值是未知的& K9 F7 m% c/ }. ?; H8 m
7、复用功能的推挽输出GPIO_AF_PP ——片内外设功能(I2C的SCL,SDA)4 {& K/ J; r( H
8、复用功能的开漏输出GPIO_AF_OD——片内外设功能(TX1,MOSI,MISO.SCK.SS): m% ~" M% T1 G7 i5 P' U

; D" q, H- k; A/ a. L" _七、STM32设置实例:/ _1 q# G' o, i0 ~, I
1、模拟I2C使用开漏输出_OUT_OD,接上拉电阻,能够正确输出0和1;读值时先GPIO_SetBits(GPIOB, GPIO_Pin_0);拉高,然后可以读IO的值;使用GPIO_ReadInputDataBit(GPIOB,GPIO_Pin_0);
' g2 {  k% R2 Z" r; G2、如果是无上拉电阻,IO默认是高电平;需要读取IO的值,可以使用带上拉输入_IPU和浮空输入_IN_FLOATING和开漏输出_OUT_OD;. ^5 `$ P8 s% J$ ^- k. l7 t5 ?& E6 f
$ _9 B5 d% w) N9 W: |7 D
八、通常有5种方式使用某个引脚功能,它们的配置方式如下:
! [; ]/ L. K# {  f1、作为普通GPIO输入:根据需要配置该引脚为浮空输入、带弱上拉输入或带弱下拉输入,同时不要使能该引脚对应的所有复用功能模块。
! ^) M$ u! x: `( i+ j& ?2、作为普通GPIO输出:根据需要配置该引脚为推挽输出或开漏输出,同时不要使能该引脚对应的所有复用功能模块。
: L0 O3 K) v, X" ]' ]$ x* G3、作为普通模拟输入:配置该引脚为模拟输入模式,同时不要使能该引脚对应的所有复用功能模块。7 p8 z, h' {0 N7 X
4、作为内置外设的输入:根据需要配置该引脚为浮空输入、带弱上拉输入或带弱下拉输入,同时使能该引脚对应的某个复用功能模块。# _$ l! T, M3 j* K$ `
5、作为内置外设的输出:根据需要配置该引脚为复用推挽输出或复用开漏输出,同时使能该引脚对应的所有复用功能模块。
5 @6 i. F  u1 ~2 H+ d
' Y/ {7 p: H0 ~! I注意如果有多个复用功能模块对应同一个引脚,只能使能其中之一,其它模块保持非使能状态。比如要使用STM32F103VBT6的47、48脚的USART3功能,则需要配置47脚为复用推挽输出或复用开漏输出,配置48脚为某种输入模式,同时使能USART3并保持I2C2的非使能状态。如果要使用STM32F103VBT6的47脚作为TIM2_CH3,则需要对TIM2进行重映射,然后再按复用功能的方式配置对应引脚。
8 @; [% A! L3 `! v* Z6 j" Y

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3#
发表于 2022-1-10 16:55 | 只看该作者
开漏输出的输出方式灵活

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2#
发表于 2022-1-10 14:24 | 只看该作者
高低电平由IC的电源决定
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