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基于cadence allegro SiP和Allegro Package Designer（APD）及Sigrity仿真的解决方案主要面向电子设计创新领域以及越来越多的要求产品小型化、轻薄化、高集成度和高可靠性的市场需求。 a/ Y8 e! O. _/ y5 a _- ]- }" u
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Allegro SiP和Sigrity芯片先进封装设计解决方案涵盖了封装设计、封装模型提取、电性能电源完整性、信号完整性分析及热分析等，为客户提供了封装设计和仿真所需要的全套工具。适用于引线框架封装，键合飞线(Wire Bond)和倒装芯片(Flip Chip)等基板封装，晶圆级封装（WLCSP），系统级封装(SIP_System In Packge)等各种形式的封装形式，在满足现阶段3D封装的情况下，又将推出更高端应用于TSV封装设计的解决方案，为IC封装设计提供业界最全面的设计与分析解决方案，满足新一代智能手机、平板电脑、超薄笔记本电脑的需要。
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Cadence Allegro SiP Layout
0 ?; v$ c: Z0 A, E4 M& H封装基板布局布线工具，该工具可以完成从简单到复杂不同层次的基板设计，能完成多管脚、高密度、多芯片堆叠、三维封装等复杂的封装设计，还提供多重腔休、复杂形状封装形式的支持。支持所有的封装类型，包括陶瓷封装、PGA、BGA、CSP等封装类型。Cadence SiP Digital Layout为SiP设计提供了约束和规则驱动的版图环境。它包括衬底布局和布线、IC、衬底和系统级最终的连接优化、制造准备、整体设计验证和流片。该环境集成了IC/封装/I/O布局性能、三维晶粒堆叠结构生成与编辑性能。另外，完全的联机设计规则检查（DRC）可支持层压、陶瓷、及镀膜技术间各种组合的复杂和独特要求。多层倒装芯片与放射状任意角衬底布线提供了快速的约束驱动互连创建。 j3 T6 F8 S! E
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& p, `8 I$ s" y9 G; N" s/ H% d5 G功能优点 ：2 \( |7 y% b. Y1 w8 L# ?
提供三维晶粒堆栈创建/编辑，以进行快速堆栈装配与优化。: R/ @8 D. c8 T+ x6 e+ {9 T+ R3 B, d
实现IC、衬底与系统级IC的I/O填补环/阵列协同设计与连接优化。
% j9 [ G4 ~. |9 R' S允许IC和衬底间的互连分配和优化，以达到基于信号完整性和可布线性的最优/最少层使用。
4 f! Z/ `$ q3 {- i( g! W: T& h通过倒装芯片晶粒自动布线-破孔，减少冗长乏味的、耗时的人工破孔编辑。( J J- A3 D& E; P* t9 f
约束导向的HDI设计，使用自动辅助互动布线，加快实行并减少潜在的错误。
, {6 c% C4 [1 m/ i) W; x# S包括全面的衬底DFM性能，以获得快速设计制造准备。8 B. c+ z7 K3 I9 C$ c+ Y
提供三维设计查看器和DRC，以获得精确的全三维键合壳验证、设计复审纠错、以及装配测试设计文件。7 ?+ {: U3 C, F; g" X% b
团队式设计分割，缩短设计周期时间并优化设计师资源。
3 }4 [ S9 R4 |2 c5 J( ^功能描述：& R H8 {# P7 [% j# o
1． 多种连接方式与灵活封装形式的支持
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2 g- d1 `! k' V9 [+ C+ K0 a# n- \$ Z! O' d9 {5 k: p8 s# P
支持多种封装工艺如：金丝压焊、周边阵列倒装芯片、以及堆栈式多硅芯片封装。& j5 [4 v! N9 O' K y& J
支持多种组建连接方式：WireBond、Flip-Chip等组件连接方式。
1 a1 K' W! K' x: O5 P2 J灵活支持RF电路和高速数字电路兼容于同一封装。
8 G* J H0 Y& ^! d; \2． 强大的布局布线能力
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SiP Layout完美驱动布局布线可实现全自动的复杂的布线要求，成熟的技术，庞大的用户群，有利于设计人员的快速上手。! S s+ e) x* j9 ` P' ?
Bonding线的灵活扇出方式和自动推挤。$ j$ i( ^+ W; _, j' d
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. r, j) r. m" o( t- Q7 [3． 规则驱动设计方法( B. G/ A& ^5 q! ?) r# n$ R
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约束驱动作为基板版图设计的灵魂，在SiP Layout封装设计中也得到了充分的体现。越来越复杂的基板设计是传统CAD工具和布线工具难以完成的， SiP Layout从原理图开始就嵌入了约束管理器器，可以方便的定义衬底布局布线的约束要求，诸如线宽、间距、线路阻抗、传输延时、差分线、阻抗匹配等的设定，针对基板上的RF信号和高速数字信号时钟，SiP Layout的约束驱动功能可以有效的保证时序的正确性。1 E7 @* t1 p6 S
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4． 封装设计3D查看与验证
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为了提高功能密度，SiP Layout设计在封装内采用了复杂的三维（3D）架构。包括堆叠金属线压焊裸片、堆叠在倒装芯片裸片上的金属线压焊裸片、裸片之间直接连BONDING线、使用媒介基板、以及包括堆叠封装（PoP）、嵌入式封装在内的其它复杂组合。% t" g2 z9 |7 z. `% m8 g* e4 V/ `
: T1 ?/ {4 M3 ^# j3D堆叠方式预览很好的帮助设计师或制造商理解层叠的堆叠方式。; u9 v$ g, M8 M r; @$ k
支持完整个设计预览或特定对象预览，例如晶粒堆栈或复杂的导孔阵列。3 `: N2 e. }6 e: G0 k. t$ p
辅助检查DFM问题，验证产品的可靠性，从而设计问题，DFM工艺问题发现在设计前端。
+ ^6 l6 d: q6 w" A* m' v; @Sigrity XtractIM封装基板仿真模型参数提取工具
4 i, S& z) D( t) EXtractIM 是一款专门针对IC封装的宽带模型提取及封装性能评估工具。XtractIM能够生成标准的IBIS格式和SPICE子电路格式的封装模型。提取出的模型可以是各引脚或各网络的RLC网表，可以是带耦合参数的矩阵，也可以是Pi/T型SPICE子电路。XtractIM生成的模型可以用来评估封装模型电性能的好坏，也可用于系统级的SI和PI的仿真。XtractIM除了比其他类似的工具仿真速度快很多之外，得到的封装模型还具有更高的精度和更宽的频带。XtractIM还可以提供基于信号和电源地的封装电气性能评估，帮助客户快速检查封装电气性能、定位设计缺陷，避免设计风险。
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2 }2 M. {( _3 zSigrity Speed2000封装信号完整性分析工具
/ I! }0 a& q3 t' P0 pSpeed2000是一款针对IC封装进行时域瞬态仿真的通用分析软件。软件采用电路求解器、传输线求解器、三维电磁场求解器可以根据IC封装的不同结构，快速而准确的分析出复杂结构内部的动态电磁效应。Speed2000真实地再现实际系统中的电源地网络，考虑芯片封装中的各种电磁效应，包括封装基板内电源地之间的波动（同步开关噪声），过孔和走线之间的耦合，以及电路和封装间的交互作用。% o" v3 ^" @8 B: w# `$ t
, l( A! r( w( y. j: j8 o, b) z1 |( ASigrity PowerSI/3D-EM封装电源完整性分析工具+ p L% d# h+ p
PowerSI可以为先进的集成电路(IC)封装供快速、准确的全波电磁分析。PowerSI对电子系统在频域中进行分析，非常适用于对集成电路的封装进行整体电磁分析。PowerSI使用了Sigrity独特的专利分析技术，在对芯片堆叠，三维键合线，基板平面上的分割、槽，多层电源/地结构，大量的通孔和走线等具体结构并在提取精确模型时使用了自适应的数值网格技术。- 业界唯一的仿真引擎自动去检测优化高密过孔算法，大大提高了仿真的精度。 - 支持从0Hz开始的全频模型段S/Y/Z网络参数提取，并通过强制S参数因果性和无源性选项，改善时域仿真结果的收敛性；自适应扫频方式，增强的低频仿真精度。- 电源网络和地网络当作非理想的情况来处理，考虑的是非理想的信号返回路径，准确提取SSN等复杂SI/PI问题。- 提取芯片封装级电源网络与信号网络的阻抗（Z）参数及散射（S）参数，找出关键的谐振频率点分布，为精确分析电源和信号的性能提供依据。- 先进的3DFEM算法提供了优秀的仿真精度，同时具备10倍于同类的产品卓越仿真效率。- 先进的高频及低频算法，确保高频精度的同时，在低频精度上大大领先于同类产品。- 同类产品中唯一集成混合仿真引擎，支持SPICE电路模型。- 支持各种单Die和多Die的封装结构，还可以模拟出封装结构中电场和磁场的强度分布。- 支持任意几何结构的剪切，可以用于简化加快超大规模电路的仿真，或者用于快速仿真局部区域的特性。- 全流程化的操作界面，软件界面自带仿真flow，用户只需根据界面提示就可轻松完成仿真任务。
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! H6 Z" M0 `- @; ^ o9 MSigrity PowerDC封装电热协同仿真分析工具
! L6 p2 K5 C% G. G' _6 |PowerDC能对芯片封装提供快速准确的直流分析和电热应力协同分析。PowerDC提供了一个step-by-step的工作流程来发现隐含的直流压降问题、电流密度问题、热可靠性问题。这些问题可能导致系统故障并带来额外的产品成本。PowerDC能够快速的给出分析结果，同时带有感应线优化和DRC检查等高级功能。分析结果可以导出用于其他相关分析。$ w* I, m/ r1 W4 O
c& w+ k1 s9 fSigrity T2B模型转换工具, _4 m+ F- H8 C% R1 w
T2B是实现晶体管级模型(SPICE)到行为级模型(IBIS)的转换工具。 |
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发表于 2021-8-16 10:38
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