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请问,晶振下方走自身的信号线,会有问题吗?

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  • TA的每日心情
    奋斗
    2025-11-11 15:35
  • 签到天数: 113 天

    [LV.6]常住居民II

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    1#
    发表于 2020-9-26 15:32 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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    如图,请大神解答
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    点评

    谢谢分享!: 5.0
    谢谢分享!: 5
    其實我看錯了,你講的是晶振電路自身的走線,不過今天我有找到答案!^_^  发表于 2022-8-1 19:01

    评分

    参与人数 1威望 +5 收起 理由
    超級狗 + 5 錯誤答案補償金!

    查看全部评分

    该用户从未签到

    推荐
    发表于 2020-9-27 13:27 | 只看该作者
    走自己的线应该没问题吧!

    “来自电巢APP”

    该用户从未签到

    推荐
    发表于 2023-1-10 08:20 | 只看该作者
    指尖的流沙 发表于 2023-1-10 08:19
    2 h" T1 [$ @; t& P; m自己的线本来就得这么走,如果不能这样走的话,那晶振的输入输出两个pin脚还能挨着么
    5 E& B/ H1 `7 B% _( t7 @! G2 a, u
    是芯片的输入输出pin一般都挨着,不能这么走说不过去
    5 E/ N$ c$ p( K* z' E# x. B

    该用户从未签到

    推荐
    发表于 2020-10-15 10:29 | 只看该作者
    这样的晶振是一个是输入,一个是反馈,而且这样的晶振频率都不高,如果是频率高的晶振会用有源的,差分线走的,自己的反馈都不能走自己下面,那这板子还咋画?
  • TA的每日心情
    慵懒
    2023-2-14 15:16
  • 签到天数: 5 天

    [LV.2]偶尔看看I

    54#
    发表于 2023-1-31 13:57 | 只看该作者
    初学滨 发表于 2020-9-27 09:118 L8 w, H& J& J" i3 ]0 Y
    晶振下方走自己的线问题不大吧。一直这样走 暂时没有发现有问题
    ' j# v6 m0 K9 {6 \, U; E" a
    我也是这么想的
    1 [/ T! M. }6 o

    该用户从未签到

    53#
    发表于 2023-1-28 10:17 | 只看该作者
    一直这样处理,绕长了反而差,就近连接就近接地

    该用户从未签到

    52#
    发表于 2023-1-17 08:50 | 只看该作者
    本帖最后由 aspire132 于 2023-1-17 08:56 编辑
    5 {, y; ~0 E) ^5 @/ ~/ u4 u# @
    ! o1 k5 b7 f6 m# h, t4 lx'tal的下方不要走線 & t+ i# D, z% N5 N1 t! K" q
    可能會讓系統產生未知的不穩定
    ( U, Y' y, V; }, Z2 d給實際routing 範例
    1 o. x- q4 z9 c  n( B" U( kC:\Users\Ian.Tang\Desktop

    该用户从未签到

    51#
    发表于 2023-1-10 11:43 | 只看该作者
    走自已的线让别人说去吧

    该用户从未签到

    49#
    发表于 2023-1-10 08:19 | 只看该作者
    自己的线本来就得这么走,如果不能这样走的话,那晶振的输入输出两个pin脚还能挨着么

    点评

    是芯片的输入输出pin一般都挨着,不能这么走说不过去  详情 回复 发表于 2023-1-10 08:20
  • TA的每日心情
    慵懒
    2023-1-5 15:11
  • 签到天数: 2 天

    [LV.1]初来乍到

    48#
    发表于 2022-12-30 14:15 | 只看该作者
    可以走自己的线,但一定要记得包地

    该用户从未签到

    47#
    发表于 2022-8-1 18:41 | 只看该作者
    本帖最后由 超級狗 于 2022-8-1 19:02 编辑
    , s: k, }( g. B6 q$ p  s6 t) V9 D
    - v, l; i$ F8 e; s: p徵求兩種佈局方式的學理解釋!0 r3 \! c9 u0 z; K2 C. n# `

    ; R) _' e( X+ N8 b; O* K/ _
    6 u: a- n+ v$ a+ r

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    Crystal PCB Layout Solution 1.jpg

    Crystal PCB Layout Solution 2.jpg (10.8 KB, 下载次数: 8)

    Crystal PCB Layout Solution 2.jpg
  • TA的每日心情
    开心
    2019-12-6 15:27
  • 签到天数: 1 天

    [LV.1]初来乍到

    46#
    发表于 2020-11-28 16:05 | 只看该作者
    用的几十M的晶振,有这样子走过,没见出现过问题

    “来自电巢APP”

    该用户从未签到

    45#
    发表于 2020-11-28 13:11 | 只看该作者
    我是来学习的

    “来自电巢APP”

    该用户从未签到

    44#
    发表于 2020-11-27 22:33 | 只看该作者
    我们就是这样建议的

    “来自电巢APP”

  • TA的每日心情
    开心
    2019-11-19 15:06
  • 签到天数: 1 天

    [LV.1]初来乍到

    43#
    发表于 2020-10-26 08:57 | 只看该作者
    一直这样画,晶振的走线不是越近越好吗,从外面绕不是更容易干扰和受干扰

    该用户从未签到

    42#
    发表于 2020-10-24 19:22 | 只看该作者
    可以的,没问题

    “来自电巢APP”

  • TA的每日心情
    开心
    2021-8-19 15:42
  • 签到天数: 21 天

    [LV.4]偶尔看看III

    41#
    发表于 2020-10-24 13:15 | 只看该作者
    没有问题

    “来自电巢APP”

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