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[Cadence Sigrity] 求助:PDN阻抗仿真如何设置VRM输出阻抗?

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发表于 2020-4-30 11:44 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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新手求助,PDN阻抗仿真如何设置VRM输出阻抗?是要导入VRM模型,在模型里设置吗?* Q5 o: r6 S# }# ?5 f! N

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4#
发表于 2024-3-5 11:25 | 只看该作者
设置 R L模型 定性分析,低频段定量分析很难。低频区也不属于PDN了,属于开关电源仿真了。班级PDN一般关注100K到100M

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3#
发表于 2020-5-3 10:43 | 只看该作者
这个比较麻烦,只能找厂家要模型或者自己测试。
6 a# t' J& w, ~( ^

该用户从未签到

2#
 楼主| 发表于 2020-4-30 13:44 | 只看该作者
mnfvbnk 发表于 2020-4-30 13:33
  h: ~+ t% W5 \3 O) W( j, ?: K假设你了解VRM的电压和电流要求,典型的目标阻抗计算用于建立VRM的输出阻抗。以12V输入3.3V/10A输出VRM要求 ...
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非常感谢,这个是计算PDN网络的目标阻抗。我的意思是在仿PDN网络是怎么给VRM输出设置阻抗,我看有的设置VRM短路,有的开路,有的给个小电阻。; {  \  k' S' i7 {2 W
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    2023-6-12 15:40
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    [LV.1]初来乍到

    1#
    发表于 2020-4-30 13:33 | 只看该作者

    [color=rgb(51, 51, 51) !important]假设你了解VRM的电压和电流要求,典型的目标阻抗计算用于建立VRM的输出阻抗。

    [color=rgb(51, 51, 51) !important]以12V输入3.3V/10A输出VRM要求为例,目标阻抗计算如下:

    [color=rgb(51, 51, 51) !important]

    [color=rgb(51, 51, 51) !important]这是MAXIMUM允许阻抗。为了允许元件容差并为开关纹波和动态负载需求提供足够的余量,通常将设计目标阻抗设置得低得多。最坏情况分析可确保不超过最大值。

      J1 W+ e) F* G' Q5 E( K

    ; s! p2 O+ _  x. J7 h. P, o

    点评

    非常感谢,这个是计算PDN网络的目标阻抗。我的意思是在仿PDN网络是怎么给VRM输出设置阻抗,我看有的设置VRM短路,有的开路,有的给个小电阻。  详情 回复 发表于 2020-4-30 13:44
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