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LVCMOS的差分信号,经电容隔直后,再偏置1.3V,差分对间接100欧电阻后是LVDS吗?

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1#
发表于 2017-9-28 10:38 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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请问LVCMOS差分信号,经电容隔直,再偏置1.3V,差分对间接100欧差模匹配电阻之后出来的后是LVDS信号吗?
9 `; u% r0 |) P- L2 q% f

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4#
 楼主| 发表于 2017-9-28 16:49 | 只看该作者
超級狗 发表于 2017-9-28 15:32+ Q* z7 f0 s0 Z- Q: ?/ M- B
你頭上戴個光環就會變成天神嗎?) ^! u1 F0 l1 v2 A7 t" e: h
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LVDS 是 D+/D- 兩條差分(Differential)訊號,LVCMOS 是單端(Single- ...
6 z8 |" w0 Q- _) _
是的是,我又配错电压了,我还想FPGA LVCMOS出来这样就变成LVDS吗,后来发现FPGA出来的也是LVDS的差分信号

该用户从未签到

3#
发表于 2017-9-28 15:32 | 只看该作者
你頭上戴個光環就會變成天神嗎?
8 t, o7 H0 E2 X8 `
0 a* H* m+ w/ @0 I4 P: rLVDS 是 D+/D- 兩條差分Differential)訊號,LVCMOS 是單端Single-End)訊號如何接得起來?* ^# S7 y- u6 M& O$ z

( s2 C  i* e: |& N$ |4 g6 u) `, }2 k5 S  t5 M. I# c1 B4 U8 o% `2 l

点评

是的是,我又配错电压了,我还想FPGA LVCMOS出来这样就变成LVDS吗,后来发现FPGA出来的也是LVDS的差分信号  详情 回复 发表于 2017-9-28 16:49
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