求助：不能在原理图中改变allegro 的布线宽度

jinyi7016 · 发表于 2015-3-24 23:00

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线宽是灰的，不能更改

zhuyt05 · 发表于 2015-3-25 12:49

本帖最后由 zhuyt05 于 2015-3-25 12:50 编辑

建网表时，点击窗口里的Setup...按钮，然后点击Configuration File后面的Edit...按钮，把里面的 MIN_LINE_WIDTH=NO
改为YES

檬茶茶 · 发表于 2015-3-26 09:40

应该可以在Allegro的规则中重新设定吧

yixin · 发表于 2015-3-26 09:36

我也有一个问题：就是每给PCB导入网表一次，PCB里设定的规则都掉了，是怎么回事，这个问题困扰了几年，也没找到怎么解决

feng0305010303 · 发表于 2015-3-25 13:21

支持下原来在这里

jinyi7016 · 发表于 2015-3-25 13:03

zhuyt05 发表于 2015-3-25 12:49
# }! d; H6 a+ W8 b, ]6 Q' P9 f建网表时，点击窗口里的Setup...按钮，然后点击Configuration File后面的Edit...按钮，把里面的 MIN_LINE_W ...

原来在这个地方啊，找了好久

huzhibin · 发表于 2015-3-25 09:20

把FILTER BY 改为allegro candance

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