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alerta 5AGXBA5 原理图设计问题

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  • TA的每日心情
    开心
    2020-1-19 15:16
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    [LV.1]初来乍到

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    1#
    发表于 2014-6-7 15:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    alerta 5AGXBA5 原理图设计的时候VERFB?AN0没用的时候,忘记接地或对应的电源了。 , T' S4 h2 h3 S: w: ^$ b% C
    板子已经做出来了,这样会有什么影响??? 2 m% O) R% V( m
    谁知道的出来说下,谢谢!
    / s* @8 b1 L/ j9 w- A0 v如果有问题就不去贴主芯片了。一个主芯片几千块啊。1 I2 [7 v9 ~# n2 q$ E

    该用户从未签到

    2#
    发表于 2014-6-9 08:45 | 只看该作者
    你应该看过altera的原理图 或说明的。VERFB这个接DDR如DDR DDR2等多要接这个。你所在的那个bank对应的VERFB没有DDR就不用接。  B) m. h7 k  d3 _# A! a
    你那个系列的FPGA没有用过,CYCLONE的是可以不接的或当IO用。
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    [LV.1]初来乍到

    3#
     楼主| 发表于 2014-6-9 12:36 | 只看该作者
    zgq800712 发表于 2014-6-9 08:45
    4 V2 R" C( D( K* o& _6 z) [5 d9 p你应该看过altera的原理图 或说明的。VERFB这个接DDR如DDR DDR2等多要接这个。你所在的那个bank对应的VERFB ...

    - `. L9 @/ `% B" p. I我是用SDRAM不用DDR   
    7 S' P" I* r( v# E我看里面说:不用的时候,接对应的电源或地;
    5 @: o7 Q4 X, o4 \; G7 N但是我板子做回来了,没接,
    8 y" I4 S1 [8 T行吗???

    该用户从未签到

    4#
    发表于 2014-6-10 18:48 | 只看该作者
    afande 发表于 2014-6-9 12:36( V' L. Q3 G2 m9 h; p
    我是用SDRAM不用DDR   
    1 y2 I  k1 {! Y4 U7 T+ b我看里面说:不用的时候,接对应的电源或地;* T+ B, g" u: r, H4 w5 l& V
    但是我板子做回来了,没接,
    . f, i) U- g- j8 F' i
    试试吧,不行可以搞成弱上拉。
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    [LV.1]初来乍到

    5#
     楼主| 发表于 2014-6-11 07:52 | 只看该作者
    zgq800712 发表于 2014-6-10 18:48' J7 x. B5 B7 o
    试试吧,不行可以搞成弱上拉。

    ; m( a7 g/ M5 e, W" y可以用软件去配置这几个IO口吧???
    7 `0 }: D( w$ @2 D9 b这些口可以配置成 高电平 低电平 或高阻/ i+ t3 q5 B- O6 A
    那我配成地电平,应该就可以了吧???
    0 C, D: l/ |6 g. g大神这行吗??

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    6#
    发表于 2014-6-11 11:17 | 只看该作者
    LZ你用Arria V 跑SDRAM是不是有点大材小用?
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    [LV.1]初来乍到

    7#
     楼主| 发表于 2014-6-11 12:35 | 只看该作者
    Newtonfifthlaw 发表于 2014-6-11 11:17
    8 b- P- K1 d6 z3 r$ }: `9 pLZ你用Arria V 跑SDRAM是不是有点大材小用?
    7 x  U8 Y8 F" L) K
    呵呵 ,是有点浪费,软件那边说DDR3的没办法做。) b3 v" g: ^: y5 ~4 e$ v
    我这个问题您知道可以吗???% I/ b3 z5 ?/ B3 t
    可以用软件去配置这几个IO口吧???7 `" v$ Y: C( C9 @: c
    这些口可以配置成 高电平 低电平 或高阻! M5 {4 O3 U6 ^( J! G& X
    那我配成地电平,应该就可以了吧???
    9 }, M- Q5 x; N! m- v7 Y# Q2 ~大神这行吗??

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    8#
    发表于 2014-6-11 19:53 | 只看该作者
    没有用DDR的就将其普通IO就好了
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    9#
     楼主| 发表于 2014-6-11 21:24 | 只看该作者
    Newtonfifthlaw 发表于 2014-6-11 19:53' M4 H) C' H) t% H; @! R$ X4 T
    没有用DDR的就将其普通IO就好了

    - V' u$ e* K9 P9 M, F7 ^7 ^) j1 z设计说明中,有说 如果不用这些口,要接对应的电源或地,那现在悬空可以吗????

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    10#
    发表于 2014-6-12 10:27 | 只看该作者
    我没有用过 Arria V 的东西,Cyclone 的东西是可以这样接的。
    ( k; J( S9 d! E- m4 K5 I在pin connection guideline 里面是这么说的:If VREF pins are not used, the designer should connect them to either the VCCIO of the I/O bank in which the pin resides or GND。$ u8 s$ G8 ^: V, x# `: D0 r6 J
    实在是不放心那就在打一版PCB吧
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    2020-1-19 15:16
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    11#
     楼主| 发表于 2014-6-12 12:32 | 只看该作者
    Newtonfifthlaw 发表于 2014-6-12 10:27
    : S* K4 z) l9 [我没有用过 Arria V 的东西,Cyclone 的东西是可以这样接的。0 {) |& s1 u: N
    在pin connection guideline 里面是这么说的 ...
    & ^- P; b7 P3 ^1 E) ]: j2 m9 ?
    板子贴好了 到时候调试看看

    该用户从未签到

    12#
    发表于 2014-6-12 13:06 | 只看该作者
    没那么多事儿,而且人家用的英语单词是should,又不是must。( Z& d- @, S/ {9 b8 ?
    这种只是厂家为了保证做出的产品可靠性更高而已,可有可无。
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    13#
     楼主| 发表于 2014-6-12 13:26 | 只看该作者
    38447448 发表于 2014-6-12 13:067 W! R/ q; m: _; z! l4 ~
    没那么多事儿,而且人家用的英语单词是should,又不是must。
    # N6 l) |( Z4 A这种只是厂家为了保证做出的产品可靠性更高而 ...
    9 c- D% I$ e6 F$ d% v& R6 _
    + l% C$ T* q: @/ R( a" B4 u2 ~
    大神 那就说,其实用的话还是可以的??' O4 Y5 I  g% M. \! m4 U& R  }( ?

    7 l3 s) a0 W! u  E5 e找到安慰了,呵呵

    该用户从未签到

    14#
    发表于 2014-6-12 14:14 | 只看该作者
    看英文呗,should啊should,不是must。功能不受影响,但是稳定性要自己测试了。

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    15#
    发表于 2014-6-12 16:27 | 只看该作者
    直接问Altera的技术支持看看
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