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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 关于Hspice模型转IBIS模型
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[仿真讨论] 关于Hspice模型转IBIS模型

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nishiyufrank

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1#
发表于 2015-11-4 18:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我在做IC的IBIS model，目前手里只有一些IP的Hspice和Spice模型，在此想请教各位高手：1. 如何将这些IP的Hspice和Spice转换为IBIS？
; q1 @  A# U2 j7 y2 r$ Z0 Z) i0 R6 `( s6 y) F' Q3 ]
2. 我想将各个IP和GPIO的Hspice和Spice转换为IBIS，再根据这些模块的IBIS手工编写一个整个IC的IBIS，此思路是否正确？$ t) F& L4 I! a
恳请大家赐教，非常感谢！
6 n$ t1 l, w7 ~8 W+ I

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nishiyufrank

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2#
 楼主| 发表于 2015-11-5 14:48 | 只看该作者
请大家多指教！

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qingdalj

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3#
发表于 2015-11-5 17:04 | 只看该作者
第一个问题太大了，我回答第二个：芯片的IBIS模型本来就是由好多子模型构成的，所以你可以把各种电平格式的模型放在一起；速率很高的信号，实现起来有点困难

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nishiyufrank
感谢版主赐教！关于这两个问题：1. 我现在想做我们SoC的IBIS model来进行仿真，但是我们没有整个IC的Spice model，只有各个IP的Hspice和Spice。我目前刚刚拿到DDR IP的CMD和DQ两个Hspice model，看了模型里面的描述  详情 回复 发表于 2015-11-5 22:11

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Head4psi

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4#
发表于 2015-11-5 17:08 | 只看该作者
兩種 tool 給你參考：1 i; C; w! r% |5 B7 t) v  A6 U( l
1. cadence / ASI 的Tool 名稱叫 : T2B/ h5 m' |5 a% ^  p2 B9 e
2. IO methodology 的Tool 名稱叫 : SIMDE

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nishiyufrank
谢谢指教，我用T2B试试看，非常感谢指导！  详情 回复 发表于 2015-11-5 22:14

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nishiyufrank

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5#
 楼主| 发表于 2015-11-5 22:11 | 只看该作者
qingdalj 发表于 2015-11-5 17:04% q' _  t3 F/ M1 ~6 x* N/ E
第一个问题太大了，我回答第二个：芯片的IBIS模型本来就是由好多子模型构成的，所以你可以把各种电平格式的 ...

# x. H7 I% ?) V: C1 v' w& w感谢版主赐教！关于这两个问题：1. 我现在想做我们SoC的IBIS model来进行仿真，但是我们没有整个IC的Spice model，只有各个IP的Hspice和Spice。我目前刚刚拿到DDR IP的CMD和DQ两个Hspice model，看了模型里面的描述不是很明白，也和IBIS model里面的语法和内容对不上，现在打算将Hspice转换成IBIS model，再通过手工的形式嵌入到SoC的IBIS model里面。如果成功，再将其他GPIO和IP的Spice model依照此方法进行转换。请问这是否可行？; m6 A$ w7 P& M: g/ o% n
2. 速率最高的应该是DDR了，其余的还有射频部分，但是我想先仿真DDR，USB，MIPI部分的SI和整板的PI，然后再用示波器去实测，进行对比来检查模型精度。( i1 U1 H0 [$ w9 e) L. u
3. 关于封装，已经和同事确认：我们可以从封装厂拿到各个管脚（BGA Ball）的RLC值，请问这个RLC值是否需要和IP Spice里面的RLC值相加后，再填入SoC的IBIS model里面？
, ~2 ~. p- L7 J9 Q4 [) }+ ~/ f+ [  L% e
恳请版主帮忙检查以上思路和方法是否正确，是否还有更好的方法和思路，谢谢赐教！, A' s, D4 s1 H6 F- z4 a. ]

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qingdalj
1.IBIS和SPICE的语法本来就不一样，所以才要转换；你要很了解这两个模型的架构和语法才行，不然会出很多错误的；思路可以。 2.DDR速率不高，我说的是那种高速串行信号 3.最好不要相加，把管脚的RLC写入IBIS就行，  详情 回复 发表于 2015-11-7 16:49

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nishiyufrank

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6#
 楼主| 发表于 2015-11-5 22:14 | 只看该作者
Head4psi 发表于 2015-11-5 17:08  M- X( r/ P1 @/ J
兩種 tool 給你參考：* x! a- g7 i9 ~. q8 ?4 m' ]
1. cadence / ASI 的Tool 名稱叫 : T2B
* o- R3 O; V+ m' \1 M+ O% V9 v! W2. IO methodology 的Tool 名稱叫 : SIMDE

7 N' p$ R" ]$ d6 l2 E" }谢谢指教，我用T2B试试看，非常感谢指导！
/ m7 [8 w: d4 V; k! o/ n

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qingdalj

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7#
发表于 2015-11-7 16:49 | 只看该作者
nishiyufrank 发表于 2015-11-5 22:115 H  `( ]# c5 V1 k3 V6 B5 \
感谢版主赐教！关于这两个问题：1. 我现在想做我们SoC的IBIS model来进行仿真，但是我们没有整个IC的Spic ...
7 h$ q) l- R9 G% D5 ~! J
1.IBIS和SPICE的语法本来就不一样，所以才要转换；你要很了解这两个模型的架构和语法才行，不然会出很多错误的；思路可以。
5 G. I& u  Q: e( v9 l2.DDR速率不高，我说的是那种高速串行信号, H( ]% m$ l3 [8 J; `/ y7 X
3.最好不要相加，把管脚的RLC写入IBIS就行，其他的可以转换的时候就带着；这里的RLC应该是串联的关系，相加的话带宽都不一样，影响还是比较大的。* Z; c. V; K3 J

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nishiyufrank
谢谢指导，我先用T2B转换模型，再进行整合。感谢您的帮助！  详情 回复 发表于 2015-11-8 22:20

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nishiyufrank

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8#
 楼主| 发表于 2015-11-8 22:20 | 只看该作者
qingdalj 发表于 2015-11-7 16:49
8 G- ~9 b/ K: L( J2 \/ a/ o1.IBIS和SPICE的语法本来就不一样，所以才要转换；你要很了解这两个模型的架构和语法才行，不然会出很多 ...

+ k3 ^% H' E8 q1 H谢谢指导，我先用T2B转换模型，再进行整合。感谢您的帮助！5 ?7 R5 w) |" T7 l; L/ z9 s

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yourjun
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    [LV.7]常住居民III
    9#
    发表于 2016-7-25 15:51 | 只看该作者
    太厉害了，我都还看不明白

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