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[Cadence Sigrity] Sigrity组件中SPEED2000仿真DDR3报错

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1#
 楼主| 发表于 2023-12-20 21:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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求助用Sigrity中的SPEED2000仿真DDR3报错如下错误9 `1 V( z, h, w6 J" W, {
Error 4040: X_pin defined in circuit SpeedXP_auto_XC7K325TFFG900_FFG900_(S1+S2+S3+S4+S5+S6+S7+S8+S9+S10+S11+S12+S13+S14+S15+S16+S17+S18+S19+S20+S21+S22+S23)_XC7K325TFFG900_XC7K325TFFG900_KINTEX7 has 3 nodes, subckt PinModel_U21_U21 has 9 nodes.' X4 ?$ ?! I$ Y  f% L
Simulation failed.
5 b2 p; Z; X. C3 S9 |0 t$ W4 O5 W1 F+ F% [# b
想请教一下这是什么原因,应该从哪些地方排查
6 U) e! h! k( D3 Y  u6 q8 x7 r- a

( F' b4 J1 |  _4 }' m

该用户从未签到

2#
发表于 2023-12-21 10:00 | 只看该作者
可以分享一下你的K7模型吗,邮箱xinbadawork@163.com

点评

不知道是不是我的模型不对导致这个地方报错  详情 回复 发表于 2023-12-21 10:09

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3#
发表于 2023-12-21 10:01 | 只看该作者
感觉是net没匹配起来

点评

是我选择的net吗?我为了验证只选择了三条net  详情 回复 发表于 2023-12-21 10:11

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4#
 楼主| 发表于 2023-12-21 10:09 | 只看该作者
狂羁青马 发表于 2023-12-21 10:00; B$ F0 M3 r6 c1 b/ ]( @
可以分享一下你的K7模型吗,邮箱

5 e3 j- \9 }( C" j; S; o不知道是不是我的模型不对导致这个地方报错

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5#
 楼主| 发表于 2023-12-21 10:11 | 只看该作者
狂羁青马 发表于 2023-12-21 10:01( m6 U' E0 K4 ]& O1 o
感觉是net没匹配起来

+ u( ?. X  e1 [  i是我选择的net吗?我为了验证只选择了三条net% q2 X+ p. u" P8 @% }

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6#
发表于 2024-4-9 16:32 | 只看该作者
哈哈哈哈,Mark一下
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