请问PCB中的走线中出现了这种shape，shape是起什么作用的？

Noahyiyou · 发表于 2019-1-13 15:35

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zhongyiacui · 发表于 2021-11-4 11:48

林果果发表于 2019-3-26 14:575 m2 A: d8 i7 S8 p0 V. ^8 m E
17.2版本有自带工具，16.6只能用SKILL了。如果你需要可以加我Q，86862832，我有这个工具。

请问时哪个工具，从来没用过这个功能，能否说以下这个走线的具体好处？

勒凹特 · 发表于 2020-6-12 09:09

intel Purley平台引入的新走线方式，https://www.eda365.com/forum.php?_dsign=f3ec57f2&mod=viewthread&page=1&tid=135181这里有人专门仿真研究过

林果果 · 发表于 2019-3-26 14:57

wanmei 发表于 2019-3-25 16:30$ L* F R K- p" K8 W6 v) w2 C
请问这中走线在Allegro 16.6中如何设置

17.2版本有自带工具，16.6只能用SKILL了。如果你需要可以加我Q，86862832，我有这个工具。

lavidayao · 发表于 2019-1-13 16:44

show一下shape的属性呢就知道是干什么的了

tyanchon · 发表于 2019-1-13 18:05

阻抗匹配的作用

鲫鱼3525 · 发表于 2019-1-14 08:09

DDR做阻抗匹配

dzkcool · 发表于 2019-1-14 09:02

这是Intel发明的Tabbed Routing

Noahyiyou · 发表于 2019-1-14 09:27

dzkcool 发表于 2019-1-14 09:02
3 r @# _* c+ k这是Intel发明的Tabbed Routing

嗯，知道了，谢谢。

Noahyiyou · 发表于 2019-1-14 09:29

鲫鱼3525 发表于 2019-1-14 08:09/ r* d6 n5 t G( w2 e' B4 B9 R" C
DDR做阻抗匹配

我查了下，好像是DDR4特有的。

Noahyiyou · 发表于 2019-1-14 09:30

tyanchon 发表于 2019-1-13 18:05" N* l6 Q: o+ d1 y
阻抗匹配的作用

请问是不是防止阻抗突变的。

EDNA · 发表于 2019-1-14 10:06

阻抗匹配

小鹿快跑 · 发表于 2019-1-14 14:39

逸步舞秋风 · 发表于 2019-1-14 20:53

intel 的tabbed routing
用于阻抗匹配
有intel 芯片平台要求

陆大少 · 发表于 2019-1-15 17:14

哲怎么弄

mars22 · 发表于 2019-1-16 10:05

Intel的Tabbed Routing,用在
CPU出PIN區域(pin field/breakout)是為了impedance control，
用在main route區域(open field)crosstalk control

wanmei · 发表于 2019-3-25 16:30

请问这中走线在Allegro 16.6中如何设置

Noahyiyou · 发表于 2019-3-25 18:07

wanmei 发表于 2019-3-25 16:30& b+ y. ~5 T# E9 |
请问这中走线在Allegro 16.6中如何设置

如图

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