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求教Alllegro ENTRY CIS输出Allegro pcb 网表的时候，。。。。

TA的每日心情

	开心 2026-4-8 15:03

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[LV.9]以坛为家II

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发表于 2011-7-18 13:44 | 只看该作者 |只看大图回帖奖励

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求教Alllegro ENTRY CIS输出allegro pcb 网表的时候，为什么老是不成功，原

理图又没错。求救？

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发表于 2011-7-18 14:02 | 只看该作者

在你的网表输出路径下有个 *.log文件,你可以打开看看,里面有不能转的原因.

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