|
|
EDA365欢迎您登录!
您需要 登录 才可以下载或查看,没有帐号?注册
x
目前常见的封装有两种,一种是电动玩具内常见的,黑色长得像蜈蚣的 DIP 封装,另一为购买盒装 CPU 时常见的 BGA 封装。
1 t+ U7 I2 f( {" c1 Y- ?8 ^3 f3 ?5 Q6 V. d9 Y
告诉你什么是封装& T( S: o6 g: e6 W! a( ~9 n2 v
7 S2 u8 \" W( K* T) Z- G% ~1 E/ j6 x9 c# R4 U
经过漫长的流程,从设计到制造,终于获得一颗 IC 芯片了。然而一颗芯片相CPU 使用的 PGA(Pin Grid Array;Pin Grid Array)或是 DIP 的改良版 QFP(塑料方形扁平封装)等。因为有太多种封装法,以下将对 DIP 以及 BGA 封装做介绍。
# D# z4 D7 K! Y# {+ U/ f
& X3 |4 d# w! g/ ]9 Y8 P0 t传统封装,历久不衰3 V& Y7 W d- V/ E- p% S
_& O9 K2 a3 F4 W首先要介绍的是双排直立式封装(Dual Inline Package;DIP),从下图可以看到采用此封装的 IC 芯片在双排接脚下,看起来会像条黑色蜈蚣,让人印象深刻。此封装法为最早采用的 IC 封装技术,具有成本低廉的优势,适合小型且不需接太多线的芯片。但是,因为大多采用的是塑料,散热效果较差,无法满足现行高速芯片的要求。因此,使用此封装的,大多是历久不衰的芯片,如下图中的 OP741,或是对运作速度没那么要求且芯片较小、接孔较少的 IC 芯片。
' b2 _ V( n! o, i' k4 q" W% j n$ [8 I0 `1 s
至于球格阵列(Ball Grid Array,BGA)封装,和 DIP 相比封装体积较小,可轻易的放入体积较小的装置中。此外,因为接脚位在芯片下方,和 DIP 相比,可容纳更多的金属接脚。相当适合需要较多接点的芯片。然而,采用这种封装法成本较高且连接的方法较复杂,因此大多用在高单价的产品上。
# P, L, }+ S* b5 h" ~: F4 { I0 z8 G
3 q: D$ y5 z3 Q0 h( _ U2 Y- B行动装置兴起,新技术跃上舞台
# T" n! o5 Y" q/ L c1 W. J4 k' N, r4 l0 ]3 f
然而,使用以上这些封装法,会耗费掉相当大的体积。像现在的行动装置、穿戴装置等,需要相当多种元件,如果各个元件都独立封装,组合起来将耗费非常大的空间,因此目前有两种方法,可满足缩小体积的要求,分别为 SoC(System On Chip)以及 SiP(System In Packet)。! [- T" X& { ?" ]) E+ y& f+ M7 K. q: D
- Y* `# L. R. E p在智能手机刚兴起时,在各大财经杂志上皆可发现 SoC 这个名词,然而 SoC 究竟是什么东西?简单来说,就是将原本不同功能的 IC,整合在一颗芯片中。根据这个方法,不单可以缩小体积,还可以缩小不同 IC 间的距离,提升芯片的计算速度。至于制作方法,便是在 IC 设计阶段时,将各个不同的 IC 放在一起,再透过先前介绍的设计流程,制作成一张光罩。( Z1 s0 t: Q6 |7 E) o" K
, V& y: l7 H5 z' d' t然而,SoC 并非只有优点,要设计一颗 SoC 需要相当多的技术配合。IC 芯片各自封装时,各有封装外部保护,且 IC 与 IC 间的距离较远,比较不会发生交互干扰的情形。但是,当将所有 IC 都包装在一起时,就是噩梦的开始。IC 设计厂要从原先的单纯设计 IC,变成了解并整合各个功能的 IC,增加工程师的工作量。此外,也会遇到很多的状况,像是通讯芯片的高频讯号可能会影响其他功能的 IC 等情形。- `$ i& r) q5 r, }5 F, k! @
5 A; r6 @9 i' P+ K: c- R此外,SoC 还需要获得其他厂商的 IP(intellectual property)授权,才能将别人设计好的元件放到 SoC 中。因为制作 SoC 需要获得整颗 IC 的设计细节,才能做成完整的光罩,这同时也增加了 SoC 的设计成本。4 g8 O5 s2 `1 B$ c3 \; w
4 t/ K: v( ~) i1 T, u( x6 P3 N5 j) u
折衷方案,SiP 现身
+ R7 B: d7 u5 Y7 E. |; J- o
, m+ @8 I( U7 X) g1 C作为替代方案,SiP 跃上整合芯片的舞台。和 SoC 不同,它是购买各家的 IC,在最后一次封装这些 IC,如此便少了 IP 授权这一步,大幅减少设计成本。此外,因为它们是各自独立的 IC,彼此的干扰程度大幅下降。
$ K1 ~2 Q1 @1 c: u) x7 U5 P* b& a5 ? B8 d$ ?
采用 SiP 技术的产品,最着名的非 Apple Watch 莫属。因为 Watch 的内部空间太小,它无法采用传统的技术,SoC 的设计成本又太高,SiP 成了首要之选。由于 SiP 技术,不单可缩小体积,还可拉近各个 IC 间的距离,成为可行的折衷方案。下图便是 Apple Watch 芯片的结构图,可以看到相当多的 IC 包含在其中。- j3 z% K7 {! |6 N1 Z: ~9 q6 |
% y& a/ z0 r6 u# b3 U
$ M% r: Q2 A% c! h2 O- i
) y4 W8 M% b# i6 E) q
▲ Apple Watch 中采用 SiP 封装的 S1 芯片内部配置图
, M% a) ~9 G3 ~' Y8 _8 b+ X5 e
& C+ M$ ^6 X' A+ j完成封装后,便要进入测试的阶段,在这个阶段便要确认封装完的 IC 是否有正常的运作,正确无误之后便可出货给组装厂,做成我们所见的电子产品。至此,半导体产业便完成了整个生产的任务。$ g- l6 R( X/ H0 x0 o6 T9 s
|
|