TA的每日心情 | 奋斗
2020-9-2 15:06 |
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# X/ R; b. w, _常见的集成电路封装形式
8 v% ?4 m$ L: v1 @; |9 h8 u1、SO封装
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- `2 C1 c9 O1 ~% G引线比较少的小规模集成电路大多采用这种小型封装。SO封装又分为几种，芯片宽度小于0.15in，电极引脚数目比较少的（一般在8~40脚之间），叫做SOP封装；芯片宽度在0.25in以上，电极引脚数目在44以上的，叫做SOL封装，这种芯片常见于随机存储器（RAM）；芯片宽度在0.6in以上，电极引脚数目在44以上的，叫做SOW封装，这种芯片常见于可编程存储器（E2PROM）。有些SOP封装采用小型化或薄型化封装，分别叫做SSOP封装和TSOP封装。大多数SO封装的引脚采用翼形电极，也有一些存储器采用J形电极（称为SOJ），有利于在插座上扩展存储容量。SO封装的引脚间距有1.27mm、1.0mm、0.8mm、0.65mm和0.5mm几种。4 S$ v g% L: S$ X
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6 z: Z! } i3 H3 |2、QFP封装6 N( {# y" C( W: t B
R# A- B* u/ d2 W+ h; HQFP（QuadFlatPackage）为四侧引脚扁平封装，是表面组装集成电路主要封装形式之一，引脚从四个侧面引出呈翼（L）形。基材有陶瓷、金属和塑料三种。从数量上看，塑料封装占绝大部分。当没有特别表示出材料时，多数情况为塑料QFP。塑料QFP是最普及的多引脚LSI封装，不仅用于微处理器、门阵列等数字逻辑LSI电路，而且也用于VTR信号处理、音响信号处理等模拟LSI电路。引脚中心距有1.0mm、0.8mm、0.65mm、0.5mm、0.4mm、0.3mm等多种规格，引脚间距最小极限是0.3mm，最大是1.27mm。0.65mm中心距规格中最多引脚数为304。
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( T7 R& F8 V. n# u; ?/ w, l K为了防止引脚变形，现已出现了几种改进的QFP品种。如封装的四个角带有树脂缓冲垫（角耳）的BQFP，它在封装本体的四个角设置突起，以防止在运送或操作过程中引脚发生弯曲变形。
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3、PLCC封装7 m$ }0 l. O+ e5 |7 y% p* p1 W
7 Y N& i: Y1 H4 K0 VPLCC是集成电路的有引脚塑封芯片载体封装，它的引脚向内钩回，叫做钩形（J形）电极，电极引脚数目为16~84个，问距为1.27mm。PLCC封装的集成电路大多是可编程的存储器。芯片可以安装在专用的插座上，容易取下来对其中的数据进行改写；为了减少插座的成本，PLCC芯片也可以直接焊接在电路板上，但用手工焊接比较困难。PLCC的外形有方形和矩形两种，方形的称为JEDECMO-047，引脚有20~124条；矩形的称为JEDECMO--052，引脚有18~32条。
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4、LCCC封装* y7 n' ~4 T9 e# R
. V% ~3 L/ n8 ~9 M5 [* qLCCC是陶瓷芯片载体封装的SMD集成电路中没有引脚的一种封装；芯片被封装在陶瓷载体上，外形有正方形和矩形两种，无引线的电极焊端排列在封装底面上的四边，电极数目正方形分别为16、20、24、28、44、52、68、84、100、124和156个，矩形分别为18、22、28和32个。引脚间距有1.0mm和1.27mm两种。
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LCCC引出端子的特点是在陶瓷外壳侧面有类似城堡状的金属化凹槽和外壳底面镀金电极相连，提供了较短的信号通路，电感和电容损耗较低，可用于高频工作状态，如微处理器单元、门阵列和存储器。5 {6 A& C+ g' H. K' g9 J
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8 f! |, w! S0 k# A" K5 v: C: D3 FLCCC集成电路的芯片是全密封的，可靠性高，但价格高，主要用于军用产品中，并且必须考虑器件与电路板之间的热膨胀系数是否一致的问题。- i! q% F/ Z' D0 I- H
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4 B% l. V( u/ E9 |8 f) X5、PQFN封装7 I# l& K9 j+ ^, t
3 s- `; D" L( A4 @* [7 sPQFN是一种无引脚封装，呈正方形或矩形，封装底部中央位置有一个大面积裸露焊盘，提高了散热性能。围绕大焊盘的封装外围四周有实现电气连接的导电焊盘。由于PQFN封装不像SOP、QFP等具有翼形引脚，其内部引脚与焊盘之间的导电路径短，自感系数及封装体内的布线电阻很低，所以它能提供良好的电性能。由于PQFN具有良好的电性能和热性能，体积小、质量小，因此已经成为许多新应用的理想选择。PQFN非常适合应用在手机、数码相机、PDA、DV、智能卡及其他便携式电子设备等高密度产品中。
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6、BGA封装- V' K, i w2 V1 }9 u' ^
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BGA封装即球栅阵列封装，它将原来器件PccQFP封装的J形或翼形电极引脚改成球形引脚，把从器件本体四周“单线性”顺序引出的电极变成本体底面之下“全平面”式的格栅阵排列。这样，既可以疏散引脚间距，又能够增加引脚数目。焊球阵列在器件底面可以呈完全分布或部分分布。
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从装配焊接的角度看，BGA芯片的贴装公差为0.3mm，比QFP芯片的贴装精度要求0.08mm低得多。这就使BGA芯片的贴装可靠性显著提高，工艺失误率大幅度下降，用普通多功能贴片机和回流焊设备就能基本满足组装要求。
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+ Z7 n( c( h" Z9 V& o' W采用BGA芯片使产品的平均线路长度缩短，改善了电路的频率响应和其他电气性能。
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- B+ `" {% N4 s5 Q. C用再流焊设备焊接时，锡球的高度表面张力导致芯片的自校准效应（也叫“自对中”或“自定位”效应），提高了装配焊接的质量。
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正因为BGA封装有比较明显的优越性，所以大规模集成电路的BGA品种也在迅速多样化。现在已经出现很多种形式，如陶瓷BGA（CBGA）、塑料BGA（PBGA）及微型BGA（Micro-BGA、μBGA或CSP）等，前两者的主要区分在于封装的基底材料，如CBGA采用陶瓷，PBGA采用BT树脂；而后者是指那些封装尺寸与芯片尺寸比较接近的微型集成电路。6 c9 ^0 ]* ?8 c4 |4 V* U% F
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0 e5 O( O0 {, d3 w: `, ?& b目前可以见到的一般BGA芯片，焊球间距有1.5mm、1.27mm和1.0mm三种；而μBGA芯片的焊球间距有0.8mm、0.65mm、0.5mm、0.4mm和0.3mm多种
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7、CSP封装
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CSP的全称为ChipScalePackage，为芯片尺寸级封装的意思。它是BGA进一步微型化的产物，做到裸芯片尺寸有多大，封装尺寸就有多大。即封装后的IC尺寸边长不大于芯片长度的1.2倍，IC面积只比晶粒（Die）大不超过1.4倍。CSP封装可以让芯片面积与封装面积之比超过1:1.14，已经非常接近于1:1的理想情况。
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在相同的芯片面积下，CSP所能达到的引脚数明显地要比TSOP、BGA引脚数多得多。TSOP最多为304根引脚，BGA的引脚极限能达到600根，而CSP理论上可以达到1000根。由于如此高度集成的特性，芯片到引脚的距离大大缩短了，线路的阻抗显著减小，信号的衰减和干扰大幅降低。CSP封装也非常薄，金属基板到散热体的最有效散热路径仅有0.2mm，提升了芯片的散热能力。
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' h0 m6 b( A A目前的CSP还主要用于少I/O端数集成电路的封装，如计算机内存条和便携电子产品。未来则将大量应用在信息家电（IA）、数字电视（DTV）、电子书（E-Book）无线网络WLAN/GigabitEthernet、ADSL等新兴产品中。
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发表于 2021-4-15 11:15
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