Allegro 17.2导第三方网表的方法

這侽孓譙悴丶 · 发表于 2019-5-20 12:30

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本帖最后由這侽孓譙悴丶于 2020-12-10 17:00 编辑

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這侽孓譙悴丶 · 发表于 2019-5-20 16:40

cxhhqz 发表于 2019-5-20 16:299 y8 X* U8 m0 I _! S/ W4 O- O
用orcad设计原理图，allegro设计pcb，大家主要用第一方网表还是第三方网表？优缺点各有哪些？能否具体详 ...

大部分是调第一方网表吧，第一方网表支持与PCB进行交互，但第一方网表比较严谨，pcb封装必须跟原理图完全一致才可以，而第三方网表调入的PCB不支持与原理图进行交互，但第三方网表没有第一方网表那么严格，比如，原理图的器件管脚数目可以比PCB封装的少，但不能多（第一方的需要一致才能将器件放下），导入报错问题比较清晰易懂，比较容易解决，第一方的报错刚开始用可能比较难找，不过用多了就知道怎么查错了！

這侽孓譙悴丶 · 发表于 2019-5-20 13:38

本帖最后由這侽孓譙悴丶于 2019-5-20 13:43 编辑

xzjialei 发表于 2019-5-20 13:26
* q: X9 k5 K' L9 J( A/ V7 t" R大神处处有，有什么办法可以将17.x的pcb降为16.x版本

方法1：网上有人在卖skill安装包，属于收费的，里面就有工具可以直接降的；

方法2：如果只是想要里面的封装或部分走线或参考设计而已的话，可以将pcb转成AD格式的，然后AD再导回低版本的allegro即可利用里面的封装或走线了；17.2的brd转AD可以参考以下链接方法：https://www.eda365.com/thread-202232-1-1.html

xzjialei · 发表于 2019-5-20 13:24

看看，学习一下

xzjialei · 发表于 2019-5-20 13:26

大神处处有，有什么办法可以将17.x的pcb降为16.x版本

anguchou · 发表于 2019-5-20 13:41

abraveone · 发表于 2019-5-20 14:10

please let me check it ,thanks

cxhhqz · 发表于 2019-5-20 16:25

看看

cxhhqz · 发表于 2019-5-20 16:29

這侽孓譙悴丶发表于 2019-5-20 13:38
. i* s! ^. C. u7 k# w方法1：网上有人在卖skill安装包，属于收费的，里面就有工具可以直接降的；. k' G2 [6 L' d& b

& ]2 _' t! C7 r; ~: r2 o方法2：如果只是想要里面 ...

用orcad设计原理图，allegro设计pcb，大家主要用第一方网表还是第三方网表？优缺点各有哪些？能否具体详细说明下，感谢。
尤其是txt文档的作用

cxhhqz · 发表于 2019-5-21 08:41

這侽孓譙悴丶发表于 2019-5-20 16:40
) V$ J% |7 |7 U; u8 u$ Q. y2 t大部分是调第一方网表吧，第一方网表支持与PCB进行交互，但第一方网表比较严谨，pcb封装必须跟原理图完全 ...

但是第三方网表也支持交互啊，而且可以代入更多信息进pcb中，第一方网表能同时代入位号和（阻容）值等，
选用哪方网表对后续仿真有影响吗？

這侽孓譙悴丶 · 发表于 2019-5-21 09:22

cxhhqz 发表于 2019-5-21 08:41
; @, q9 ]$ v Y8 Q但是第三方网表也支持交互啊，而且可以代入更多信息进pcb中，第一方网表能同时代入位号和（阻容）值等，* ~$ W" x0 `/ M7 X+ H3 {
...

对仿真不存在影响吧！

bingshuihuo · 发表于 2019-5-21 13:06

看看，学习一下

yangjf_sh · 发表于 2019-5-22 10:24

看看，学习一下

lylicquit · 发表于 2019-5-22 11:10

路过，先看看

melody55555 · 发表于 2019-5-22 15:15

kankan

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