DDR异面背贴地址等长

fengsheng1015 · 发表于 2025-7-19 18:52

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请问DDR背对背放置，地址线怎么设置等长呢？FPGA和正面的芯片等长了，和背面的芯片就不等长了？

wen11902 · 发表于 2025-7-21 09:12

你说的是FPGA 、正面DDR 和 FPGA 、背面DDR的地址不等长？不用等长啊，你把每颗ddr与FPGA的地址等长就行。fly-by

dianchao5801 · 发表于 2025-7-19 20:48

是不是要每两个个DDR之间的先绕等长完再设定下一组的等长设定？

kmarkou · 发表于 2025-7-21 01:54

豆腐干地方

cailiu · 发表于 2025-7-21 09:08

是不是要每两个个DDR之间的先绕等长完再设定下一组的等长设定？

lc1234 · 发表于 2025-7-21 13:47

wen11902 发表于 2025-7-21 09:12* U f4 `: g0 M0 _* t* s+ ~5 ~
你说的是FPGA 、正面DDR 和 FPGA 、背面DDR的地址不等长？不用等长啊，你把每颗ddr与FPGA的地址等长就行。f ...

正反贴的DDR能要做fly-by拓扑么，

Dcec50VIW3AE · 发表于 2025-7-22 14:15

看拓扑结构的，走FLYBY还是T，分别设置主控到颗粒的等长就行了呀？

kingweison · 发表于 2025-7-24 09:21

:):)

fengsheng1015 · 发表于 2025-7-28 13:15

wen11902 发表于 2025-7-21 09:12% F! R; W$ r5 |, a5 z! b, t
你说的是FPGA 、正面DDR 和 FPGA 、背面DDR的地址不等长？不用等长啊，你把每颗ddr与FPGA的地址等长就行。f ...

但正反面做不到flyby的方式。。。

fengsheng1015 · 发表于 2025-7-28 13:16

Dcec50VIW3AE 发表于 2025-7-22 14:15
2 P7 A; V+ i9 S看拓扑结构的，走FLYBY还是T，分别设置主控到颗粒的等长就行了呀？

就是走线中，既有T点的，又有flyby的

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