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现在我画好了原理图,准备LAYOUT.但在生成LAYOUT NETLIST 的时候,出现了较多错误,主要归结为以下几条:
, \) w7 |: f% D5 | 1.在LOGIC里,所有的元件我都已经分配了封装,但在生成NETLIST 的时候,除了原先LOGIC 自带的封装导进了LAYOUT,其它我自己建的很多封装都没有导进去.
( q" q, t0 t8 q1 @0 A, U2. 请问一下在pads LOGIC 里面,为什么我用浮点连接不行.在转LAYOUT的时候,有一个"Dangling Connections without a Net Name" 的提示8 [6 Z8 {3 r# w6 c* {9 B& ?
3.关于电源和地的问题.我的原理图中,我将就它原先的电源和地符号,只是把它的NET NAME 改成我的电源,不知道这种做法是不是不可行.因为在转LAYOUT的是时候,它也有一个"Power or Ground Symbols used with wrong Net Name" 的提示.& U! l/ ~ F) ^5 ~9 N
# C s9 w" m1 N, K
这几个问题困扰了我以两天，不知道怎么解决。希望哪位高手指点一下 |
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发表于 2009-8-7 16:32
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