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如何将manufacturing层某个层的一个线段变到ETCH层的TOP层??

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1#
发表于 2015-8-3 16:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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将manufacturing层某个层的一个线段变到ETCH层的TOP层??( h4 S/ Y: H1 E
坐等高手解答1 @& x, @. k$ Y, w( c1 n8 b2 |
谢谢!

该用户从未签到

2#
发表于 2015-8-3 17:10 | 只看该作者
subdrawing出去,用记事本或者UE将manufacturing\XXXXXX的替换为ETCH\XXXXXX.

点评

然后再import进来这个subdrawing。  详情 回复 发表于 2015-8-3 17:11

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3#
发表于 2015-8-3 17:11 | 只看该作者
武紫旭 发表于 2015-8-3 17:10
5 B8 V! B$ F" l3 isubdrawing出去,用记事本或者UE将manufacturing\XXXXXX的替换为ETCH\XXXXXX.

) A  O1 t8 B/ ?: C# ?) m" W- j然后再import进来这个subdrawing。3 _* y8 X' `) ^; j7 \  g; _' T
  • TA的每日心情
    无聊
    2023-11-1 15:41
  • 签到天数: 1 天

    [LV.1]初来乍到

    4#
    发表于 2015-8-3 17:11 | 只看该作者
    可以用sub-drawing的方式导出去,然后打开编辑clp文件,将manufacturing/XX全部替换成ETCH/TOP再导进来就好了

    该用户从未签到

    5#
     楼主| 发表于 2015-8-3 17:19 | 只看该作者
    manufacturing层某个层丝印线line变换到etch下面的电气线??

    该用户从未签到

    6#
     楼主| 发表于 2015-8-3 17:24 | 只看该作者
    不管用什么方法,谁能够把% }: b+ q0 F+ ?4 G# w/ n3 a
    manufacturing层某个层丝印线line变换到etch下面的电气线??1 ]" Z. J" J! Y- U/ C2 ^
    坐等高手

    该用户从未签到

    7#
    发表于 2015-8-3 17:54 | 只看该作者
    二楼说的很清楚了!你操作下就知道了!:lol:lol
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    8#
    发表于 2015-8-3 20:42 | 只看该作者
    这种方法是不行的,导入以后还是line的属性,无法与信号走线相连,还需要再改进一下。
    ( Z5 K3 n2 }9 U% j# X1 y, a
      x9 D( q, X7 ~) }, x+ d8 e' w如果是16.6版本,可以直接先改为top层的line在General edit(Setup->Application Mode->General Edit)模式下选中line,然后选择右键菜单中的Change class/subclass->Etch->Top,这时Line就是Top层的了。
    & z7 [0 V7 ?% I7 j+ j然后再将此Line导出Subdrawing文件,修改所有的“_clp_dbid = _clpDBCreatePath(_clp_path "ETCH/TOP" 'line _clp_sym _clpPl)”中的‘line为nil,再导入Subdrawing到PCB中,即可与现有走线、管脚、过孔相连。% s8 r; W( P' T# ~, y  {
    ) d7 i$ s; Y# }) P; O

    点评

    我的是16.3的,我subdrawing出去,用记事本把board Gemmetry\outline的替换为ETCH\top. 然后把_clp_dbid = _clpDBCreatePath(_clp_path "ETCH/TOP" 'line _clp_sym _clpPl)”中的‘line为nil,再导入Subdrawing到PC  详情 回复 发表于 2015-8-4 10:57

    该用户从未签到

    9#
    发表于 2015-8-4 10:57 | 只看该作者
    dzkcool 发表于 2015-8-3 20:42
    ; o1 p8 O. p/ r5 F, \+ d8 Y, U/ W这种方法是不行的,导入以后还是line的属性,无法与信号走线相连,还需要再改进一下。
    & y7 Z! W# x3 P
    3 m, y% D6 m% @0 l如果是16.6版本, ...
    4 h* `7 s! K1 Z6 e9 T/ F$ O% A& ]7 z
    我的是16.3的,我subdrawing出去,用记事本把board Gemmetry\outline的替换为ETCH\top.  然后把_clp_dbid = _clpDBCreatePath(_clp_path "ETCH/TOP" 'line _clp_sym _clpPl)”中的‘line为nil,再导入Subdrawing到PCB中,提示如下错误, o  m0 m) L7 u
    1 y8 w! \$ o. {
    *WARNING* (axlDBCreatePath): Net name not found - nil_clp_sym% n2 x# L. B0 B
    Unable to paste object of type "path" on layer ETCH/TOP.0 e8 ^( f, [6 v6 m

    * ]# g5 M, O1 z; M$ k+ n1 c没有网络名,导不进去。怎么解决呢?谢谢!
    8 d: q# h5 }" ~+ r: n# J0 o. }/ r( y# U; l  I

    0 \0 F: I9 E' D* q1 Y3 Z
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    [LV.8]以坛为家I

    10#
    发表于 2015-8-4 11:11 | 只看该作者
    nil前后有空格哦,把修改后的"_clp_dbid = _clpDBCreatePath(_clp_path "ETCH/TOP" nil _clp_sym _clpPl)”贴出来看看
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