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[Cadence Sigrity] Allegro Sigwave 仿真DDR3的波形如何删除Vih及Vil

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1#
发表于 2013-1-3 12:36 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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allegro Sigwave 仿真DDR3 DRAM的波形系统会自动在波形上显示出Vih及Vil,因为我要看其他的电压值,为避免混淆,能否通过设定不显示出Vih及Vil?如图所示,希望快速删除粉红色显示的Vih及Vil。因为DRAM比较多,我现在的做法是在左边列表中选中Vih及Vil一一删除,很烦琐。请指教,谢谢!
; C- h6 `5 P6 n

u6.jpg (222.93 KB, 下载次数: 9)

u6.jpg

该用户从未签到

2#
 楼主| 发表于 2013-1-4 08:52 | 只看该作者
非常感谢您的回复,我看到IBIS模型中有Vinl,Vinh的设定,如果改IBIS的话的确会影响后续的分析,两难啊。

该用户从未签到

3#
发表于 2013-4-9 16:08 | 只看该作者
直接点中那根线 向上或下 猛拖 ,拖到边界 就没了
. I6 ?/ u! ^: {* L
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