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ALLEGRO 如何给散热焊盘赋予网络

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1#
发表于 2015-12-22 09:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请问如何实现
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QQ截图20151222100115.png
  • TA的每日心情

    2020-7-21 15:38
  • 签到天数: 21 天

    [LV.4]偶尔看看III

    3#
    发表于 2015-12-22 10:31 | 只看该作者
    我发现静态铜硬来是个通用的方法~

    该用户从未签到

    4#
    发表于 2015-12-22 11:16 | 只看该作者
    在原理图里面修改

    该用户从未签到

    5#
     楼主| 发表于 2015-12-22 11:23 | 只看该作者
    就是不期望改原理图,没有别的办法了吗

    该用户从未签到

    6#
    发表于 2015-12-22 11:30 | 只看该作者
    用属性铜皮覆盖.
  • TA的每日心情
    开心
    2019-11-19 15:59
  • 签到天数: 1 天

    [LV.1]初来乍到

    8#
    发表于 2015-12-22 15:41 | 只看该作者
    静态铜,硬来!

    该用户从未签到

    9#
    发表于 2015-12-22 16:27 | 只看该作者
    不想在原理图中改网表,allegro也可以更改/增加网络连接,具体方法如下:1 g) s; V+ \1 Q# M" y
    菜单栏Logic—Net Logic命令,在options中选择你希望赋予的net(也可以create新的网络),然后点希望赋予网络的焊盘。
    ( S% t( S: @0 o! X0 N当然,还是推荐改网表,一致性比较好。

    该用户从未签到

    10#
    发表于 2015-12-22 17:00 | 只看该作者
    建议在原理图中改,如果在PCB中改的话,会有隐患,除了你给标明或者能够记得住

    该用户从未签到

    11#
    发表于 2015-12-22 21:32 | 只看该作者
    这种器件不要走偏门,习惯就很不好.建LOGIC LIB的时候就加上属性。

    该用户从未签到

    12#
    发表于 2015-12-23 16:30 | 只看该作者
    同意以上所说,不改原理图而改pcb,就造成了原理图和PCB的不match,风险较大,还是改sch或者铺死铜强制short。。
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