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问题一:, O- q, c0 y1 A: p; I
logic同步到layout时,出错如下:
A P# o8 N7 _: b# \# w
3 H1 q" a' Y* C; c$ _Line 19 , Section *MODIFY_GENERAL_RULES*' _/ p g& @7 W- l0 r. w! r: B
VALID_VIA_TYPE STANDARDVIA7 ]5 o2 }# F, L; j( h9 r3 s8 M
* There is no Via type STANDARDVIA in design5 H6 a4 D- b5 ~% p
我将layout中的过孔名称改为“STANDARDVIA”后再同步,不会出现错误提示,不知道是什么原因?) b6 S: \/ }* i3 _8 n
" d( {/ F: l) O: q问题二:2 M) }' J7 l2 l- X0 Z5 R6 |
在画board cut out和board outline时,在Drafting Properties对话框中,更改width项后不起作用,在PCB中线宽还是默认的0.0254,不知道是不是哪没有设置好。如图1所示:, a/ |7 J3 m, E- z5 k$ J0 b* `7 Z$ e
9 G" c; U% |& ^4 e n问题三:5 I" z. H y5 b. t8 i K* Y! V0 p
在layout中,若有很多个相同的board cut out时,能否通过复制来完成,包括copper pour也是的,请高手帮忙解答以上一个问题,谢过! |
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