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[Cadence Sigrity] Sigirty仿真的目标阻抗为什么刚开始特别大?

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1#
发表于 2017-2-24 10:43 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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各位大神:Sigirty仿真的目标阻抗为什么会出现椭圆部分?! y. q$ q) j8 c# E4 O! Q. B1 h

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QQ图片20170224104853.png

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2#
发表于 2017-3-27 13:42 | 只看该作者
电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效

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怎么添加的呢,求指导啊  详情 回复 发表于 2022-10-19 11:13
vrm加上了 但我怀疑软件是不是没有读取?  详情 回复 发表于 2017-3-27 15:34

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3#
 楼主| 发表于 2017-3-27 15:34 | 只看该作者
icy88 发表于 2017-3-27 13:42
3 }0 ~* k8 o7 U6 |* x电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效

6 |+ m& G- W! V0 Q7 x' y' ^vrm加上了 但我怀疑软件是不是没有读取?
1 q+ x; s- I& h* p5 U2 |% S( V

点评

那你查下,电源通路中其他地方有开路的地方,如中间的串接电阻,电感之类的没有赋值  详情 回复 发表于 2017-3-28 10:10

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4#
发表于 2017-3-28 10:10 | 只看该作者
JLP7878 发表于 2017-3-27 15:34: P& d" c5 f4 P- s* J
vrm加上了 但我怀疑软件是不是没有读取?

7 r- h( s! N! e1 @8 N( p4 r那你查下,电源通路中其他地方有开路的地方,如中间的串接电阻,电感之类的没有赋值
" |( q0 ^" l! V. O

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5#
发表于 2017-3-31 21:23 | 只看该作者
做PDS阻抗仿真需要做到几百MHz吗?我看intel Romley手册,PCB板级去耦设计只需关注1~2MHz就可以了

点评

看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m或200m之前,再大板级去耦就发挥不出效果了  详情 回复 发表于 2017-3-31 15:54

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6#
发表于 2017-3-31 15:54 | 只看该作者
DaiXL 发表于 2017-3-31 21:23
+ Y1 l  H% M2 _5 A8 v做PDS阻抗仿真需要做到几百MHz吗?我看intel Romley手册,PCB板级去耦设计只需关注1~2MHz就可以了
) l9 d' P& _( X
看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m或200m之前,再大板级去耦就发挥不出效果了

点评

板级去耦需要做到100~200MHz?这么高,我一般都是做到几十M  详情 回复 发表于 2018-4-9 17:40

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8#
发表于 2017-7-5 00:36 | 只看该作者
低频不用管,只需关注20~100M就好,VRM短路,低频就很低

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10#
发表于 2018-4-9 17:40 | 只看该作者
icy88 发表于 2017-3-31 15:54
8 p2 B8 K: Y+ t3 @% J看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m ...

0 ]# k8 t4 x2 x6 N板级去耦需要做到100~200MHz?这么高,我一般都是做到几十M
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11#
发表于 2018-5-14 10:27 | 只看该作者
阻抗不匹配

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12#
发表于 2018-5-14 10:27 | 只看该作者
阻抗不匹配

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13#
发表于 2019-7-10 13:19 | 只看该作者
学习下,刚接触PI仿真

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14#
发表于 2022-10-19 11:13 | 只看该作者
icy88 发表于 2017-3-27 13:42' A2 k1 i) }6 W% i7 |# S
电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效
1 ^) o% O+ w$ ]1 @0 Q+ A
怎么添加的呢,求指导啊, f( u! h+ n, h8 c1 h
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