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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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1#
发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准- D5 p' T9 G% }$ G: d
哪位大师可以给参考资料' S) h! j! f# T% u/ Y+ x4 n

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推荐
发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:02
# ~: e" H5 G( K! o, z我公司的某PCBA 发到 I....公司做测试。2 c* ]& h- `3 T: f- R/ v
他们反馈的信息是. : j8 c. m+ Q1 d7 [! P
--Find a problem during return loss tes ...
+ f6 L0 y1 |1 \0 [4 N# D8 a; D8 z
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?9 J2 O. Q6 @/ s: W' V4 r
Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。) l" z% Z- H4 y7 X$ W

3 f$ s8 _" e4 l, l2 y2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!0 J/ P3 t. K. E) k0 p  ?
RL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。, l) v$ f9 V7 Y$ J" S5 J1 l( i

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4#
发表于 2014-11-22 09:36 | 只看该作者
先参考协议; ]$ f& d: V6 i4 E, s& J
再根据走线长度来定,关键还是接收端可接受level

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5#
 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36
3 C3 R+ f  }+ ~( b) _5 U2 f先参考协议
: i, k1 J; b) b2 |8 |再根据走线长度来定,关键还是接收端可接受level

+ x1 v) h8 m/ @. h虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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6#
发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08
8 J  U7 N9 h6 a& L! K' k8 |% E虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
2 A& N- p# e, L; Q2 @
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。
2 v0 F0 R# X2 X# ?/ Q

点评

那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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7#
 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
) W- \( k  ?: N; @9 B因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

5 Y9 ~1 I  }$ ?# ]/ Y* K我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况" R4 K; j( C2 o1 V( t* L

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8#
发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:035 e! k: x' o. P( H* }8 ^! s% q) h
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

$ D0 Z# C2 B+ p! [; d. T% j那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?, ]( V. Q6 Q: i- _

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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9#
发表于 2015-11-1 10:32 | 只看该作者
964008794 发表于 2015-10-31 23:36$ B7 e$ V# F- T( n$ h  f
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
3 D& J0 ]: ]8 m( E/ F% z7 }
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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10#
发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:32, ~* w' c( Y6 ]8 A
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

1 v4 H! \! ?2 J5 \7 ^我公司的某PCBA 发到 I....公司做测试。
# i& J6 _' P$ _4 h他们反馈的信息是.
& j' S( \6 k+ \--Find a problem during return loss test on T..3 connectors. + j/ L% t: A# C% s  {' ^6 \4 v0 F
此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。 ! F# h- l4 P- F* O& P
我的问题是:
3 q# t6 U" u+ E0 [% M8 Y1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?; I: e% _4 c$ c" e4 T4 g, [1 {
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
  K/ i3 I3 ~1 F% |; i3 b/ D$ b
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4 {# _& w" V" n6 J/ C/ O5 c

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10

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12#
发表于 2021-9-17 11:18 | 只看该作者
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