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DSP之 keystone架构组成部分

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发表于 2019-7-18 10:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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keystone架构组成部分
. ]6 Q4 T; n$ ?4 K# w
* _4 `& p. ^5 U6 r0 I, z
( ]+ N2 Q) s: v
1).全新的C66x定点/浮点内核:速度高达1.25GHz的高性能DSP内核,单个器件上可实现最高320GMAC和160GFLOP定点及浮点整合性能,整合多个DSP,节省板级空间,降低成本和电源需求。
# X  l# P; F6 ]8 m' h, Q# B$ H! e( ?8 W: o0 V

; q# O! H2 j( s# q7 f2).可配置协处理器:用于减轻系统微处理器的特定处理任务。
. g( i- [1 o: [* p4 |
1 Y* r; Y$ Y, V. l; R- r

6 C2 p. ~3 F+ B) D# {3).层级存储器:重点讲述。
4 t+ E" m$ d: }+ g0 s& _
/ v  m* q$ u+ N& ~

" g2 d+ Q  P/ [/ u4).TeraNet交换结构:芯片内部总线矩阵。. H, t3 a/ I) `) x9 v" Q# D

) H$ k+ X+ I9 ~% _
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5).多内核导航器(Multicore Navigator):将上述组件连接在一起,是一个创新的基于包的管理器,它控制8192个队列,当任务被分配到队列,多核导航器提供硬件加速分配(把任务分配给相应的可采用的硬件),不需要耗费TeraNet资源,包的搬移不会被内存存取阻塞。
% B% t% Z) B$ S8 i0 v' V/ k9 ?' Y4 q$ ?5 P$ F
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& u) K' L# I, C' x9 R
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发表于 2019-7-18 18:58 | 只看该作者
keystone架构组成部分5 K-
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