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ARM ------- 内核领域

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发表于 2019-7-9 10:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 mytomorrow 于 2019-7-9 10:22 编辑
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5 H3 g1 c/ C7 i. p7 l4 o( N 本文摘自:亚嵌在线直播课堂之如何学习ARM嵌入式开发-李明$ e* Y9 f  W0 b+ Q9 m; s
; ]- J% {) ]' q- \" ~4 e3 T
  • ARM体系结构
    ! d+ k- v" {0 I( M, T

* z; ?3 t  C4 h- ^- bLoad/Store体系,Big/Little Endian大小端格式,RISC/CISC指令集,Pipeline流水线
' }- t" {1 C' {# X5 g- `' _" ?& D
4 o- y; q( h' s0 W% L
  • ARM工作模式
    * N4 @( w+ @4 L8 n& ?, U1 r
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7种工作模式:USR,SYS,SVC,IRQ,FIQ,UND,ABT;其中5种异常模式
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  • ARM寄存器, ?7 k4 `/ U0 h3 d% R; C

- s! [, I0 ^* C4 ~37个寄存器:R0-R12, R13(SP),R14(LR),R15(PC),CPSR(SPSR)& j3 O3 k) N  }/ q) k" k" x
7 e7 V* m- F- v) O

' B; B. C5 s  E
  • ARM异常& f$ }" ~0 A" e8 A
$ l3 @; M8 T" a1 Z1 d/ K; ?) C) w
7种异常,异常向量表,异常优先级,异常处理程序,处理器现场,现场的保存和恢复
: J6 c! a/ }& r  z5 H$ o7 }( x5 I$ z0 l7 c* C1 g4 w& c; n
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  • AMBA总线% F3 I, G+ r( J& L" E+ h; Y

! t. G3 J3 N4 K  |8 O3 lAHB(高性能总线),ASB(系统总线),APB(外设总线)
7 E" j  x& T, w  O/ ~& h
5 B, e! y+ G# {& J
  • ARM内核技术
    1 C. E+ |" B: C- C1 `* _/ ?( [

. Y: o. T2 D) H1 r; M$ H! f/ hTrustZone,Jazelle,NEON,Thumb-2,SIMD,MMU,MPU4 c4 H2 {/ ^  e
; O# t0 x3 M5 _* Q
  • JTAG标准9 o$ l/ P$ j! s! m  z1 J
7 i& i, L' R# j8 Q" x
IEEE1149.1,TDI,TDO,TCK,TMS,TRST,边界扫描链,H-jtag,Banyan,GiveIO, t, a5 v3 l" v3 @- f
/ P1 v- O7 Y/ X$ ~$ m/ K4 j

0 g6 f# c7 B5 B7 J  R
  • ARM内核分类
    5 H3 ~2 ^0 @+ e' D, e3 L

* ?& o1 W, v  q+ n( z9 fARM7TDMI,ARM926,StrongARM/XScale,ARM10,ARM11,Cortex-(A/R/M),SecurCore; M! z/ H" ~& f8 h  J
. h/ [1 [' p& E( ?2 y) r; d- h# _/ `( K
, H& D) O+ V& S- d0 [
  • ARM汇编指令& F# S/ N1 J1 z' _# H8 Q) B

: A! J1 `3 [$ A8 h4 s& Emov,add,sub,b,bl,ldr,str,ldmfd,stmfd,mrs,msr,swi,mrc,mcr( J" X9 R& G5 B+ j9 z/ e5 o

) R; J1 P/ g( M( V2 U  N
  • MMU内存管理单元
    + q2 B; F0 E: a5 V0 z8 M

9 S, C+ C# V: ?, H( U+ S1 IVA/PA,I-Cache/D-Cache,Write Buffer,Context Switch,CP15,TLB,AP,Domain Access Control,Cache Coherence
& Y+ T  u+ T7 `; F* `  [( v+ E! ~, U6 y" t
# q4 }8 `! y9 k* g
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发表于 2019-7-9 16:42 | 只看该作者
研究一下内核领域相关知识
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