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EDA365电子论坛网»电子社区 › 研发技术版块 › 芯片SIP|封装设计 › Ansys(Ansoft) TPA对flipchip case提取RLC问题求助
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Ansys(Ansoft) TPA对flipchip case提取RLC问题求助

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blackcrows

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1#
发表于 2016-9-6 10:23 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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求助论坛大拿，cadence的mcm格式文件()转换导入TPA后，在修改stack中die层为wire bond后，编辑bond wire profiles后，但是terminal type中仍bond wire terminal仍然没有信号。麻烦问大家是我TPA设置有问题呢，还是原有 原mcm文件中对bump需要特殊设置呢？谢谢大家。
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bond wire profile.jpg (13.22 KB, 下载次数: 9)

bond wire profile.jpg

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pjh02032121

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2#
发表于 2016-9-8 22:07 | 只看该作者
要设置die的属性

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denny_9

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3#
发表于 2016-9-20 18:05 | 只看该作者
FC的怎么跑去设置WB呢。

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blackcrows

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4#
 楼主| 发表于 2016-9-21 11:26 | 只看该作者
@pjh02032121 9 d9 z3 |3 b8 b9 F, h" [9 d
潘总，是在TPA的layer stackup设置么,还是APD里面呢？7 b. |3 o* v4 u* s' w) t

8 R) Q" b) r9 B: V* z
' h5 j) M" R' j@denny_9 $ `* a0 ^& D# B7 P8 e
求两位大拿解惑。* s5 Y( f" v' `1 F' B; ?
谢谢" n3 U" d- x8 p6 |" f

9 W/ e8 H+ C8 X- O) _
  _$ H- A' P) h2 ]* F

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锤子米啊

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5#
发表于 2017-1-3 13:38 | 只看该作者
你的TPA软件安装包和破解包能发我一份吗？

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denny_9

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7#
发表于 2017-6-9 14:36 | 只看该作者
blackcrows, 你是哪个公司的。

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