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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › DDR等长设置再次求教？
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DDR等长设置再次求教？

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gdli

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1#
发表于 2017-3-6 21:37 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
DDR等长很多资料里面讲参考CLK+-200mil，组内等长10mil,那么在走线的时候CLK长度1810MIL，地址线=1810+-200mil也就是1610-2010的设置范围，可是组内等长10mil，那这个地址线的长度范围我改怎么设置呢
$ p& p$ M& g5 T) G+ X* ~; c7 x

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土豆你个马铃薯

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发表于 2017-3-6 15:25 | 只看该作者
gdli 发表于 2017-3-6 14:59- J  Z- F" b( @0 h
这个长度设置在哪个范围呢
, T" b6 v' G- [' e5 V; j: ^
一般情况是：DQS与CLK放在一组内，规则设置在+-200，然后在分组，DATA的以DQS为基准每组控制10以内，地址线的以CLK为基准控制在10以内，这种情况很难做到，一般会视情况有所放宽，绕的时候还需要注意DATA线中最长的不能比CLK长200（一般不会有），最短的也是如此（这个很坑爹，会然让人想哭）
& L& @# Q) U% u/ P' @8 v

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gdli
CLK长度1810MIL，地址线=1810+-200mil也就是1610-2010的设置范围，可是组内等长10mil，这个地址线的组内等长范围该怎么设置呢  详情 回复 发表于 2017-3-6 15:28

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gdli

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 楼主| 发表于 2017-3-6 15:28 | 只看该作者
土豆你个马铃薯 发表于 2017-3-6 15:25
9 ?* N2 y. X! Q6 E. [一般情况是：DQS与CLK放在一组内，规则设置在+-200，然后在分组，DATA的以DQS为基准每组控制10以内，地址 ...
% ?& u0 x: h0 q
CLK长度1810MIL，地址线=1810+-200mil也就是1610-2010的设置范围，可是组内等长10mil，这个地址线的组内等长范围该怎么设置呢
; [$ b( e/ |1 i5 |  n

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gdli
是不是设置在2010+-10mil呢  详情 回复 发表于 2017-3-6 15:31

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gdli

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 楼主| 发表于 2017-3-7 10:38 | 只看该作者
土豆你个马铃薯 发表于 2017-3-6 16:48  V! |5 [. T7 y! h
找到你地址线里面最长的那根线，所有的线控制在比他短100以内就好了，包括CLK，如果，CLK最长，则用CLK减 ...
$ Q, ^1 r" x6 h4 Y
DDR1333    地址/控制总线/时钟-----数据总线的布线长度<1200MIL.这样提示是什么意思呢
8 |1 B- Q, o: i: h2 P; p7 O' [

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土豆你个马铃薯
给我截图吧，我看下，顺便把你ddr的地址和数据线的要求也截个图给我  详情 回复 发表于 2017-3-7 17:16

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仁爱

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2#
发表于 2017-3-6 10:04 | 只看该作者
你把所有地址线和CLK先放一组，组内等长10MIl，等长做好后，你再把CLK拉长200MIL不就行了

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仁爱

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3#
发表于 2017-3-6 10:04 | 只看该作者
你把所有地址线和CLK先放一组，组内等长10MIl，等长做好后，你再把CLK拉长200MIL不就行了

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仁爱

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4#
发表于 2017-3-6 10:04 | 只看该作者
你把所有地址线和CLK先放一组，组内等长10MIl，等长做好后，你再把CLK拉长200MIL不就行了

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gdli
这个组走线最长的现在是2442 最短的是1335，这样去做等长百分之80的线都要调整的,,可是空间又有限，怎么办好呢  详情 回复 发表于 2017-3-6 10:26

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gdli

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5#
 楼主| 发表于 2017-3-6 10:26 | 只看该作者
仁爱 发表于 2017-3-6 10:04  d7 q/ c1 Y  A7 T: Q$ ~
你把所有地址线和CLK先放一组，组内等长10MIl，等长做好后，你再把CLK拉长200MIL不就行了

" o) r( {% W( C* T, V这个组走线最长的现在是2442 最短的是1335，这样去做等长百分之80的线都要调整的,,可是空间又有限，怎么办好呢6 _) R3 Z5 a% k  G0 x0 D

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土豆你个马铃薯

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6#
发表于 2017-3-6 14:47 | 只看该作者
我做过这种要求的DDR，它说的参考CLK，是说data线也要参考CLK的长度，然后其他的在组内也需要在+-10内，这个要求很高了

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gdli
这个长度设置在哪个范围呢  详情 回复 发表于 2017-3-6 14:59

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7#
 楼主| 发表于 2017-3-6 14:59 | 只看该作者
土豆你个马铃薯 发表于 2017-3-6 14:47
0 m7 _$ q8 x+ W: e7 I& D$ g, H- ?我做过这种要求的DDR，它说的参考CLK，是说data线也要参考CLK的长度，然后其他的在组内也需要在+-10内，这 ...

2 X% M4 _4 k( w: e( B1 B+ U这个长度设置在哪个范围呢
" G% Y  M7 b) l2 t

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gdli
具体是这个要求，长度设置范围怎么定  详情 回复 发表于 2017-3-6 16:15
土豆你个马铃薯
一般情况是：DQS与CLK放在一组内，规则设置在+-200，然后在分组，DATA的以DQS为基准每组控制10以内，地址线的以CLK为基准控制在10以内，这种情况很难做到，一般会视情况有所放宽，绕的时候还需要注意DATA线中最长的  详情 回复 发表于 2017-3-6 15:25

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8#
 楼主| 发表于 2017-3-6 15:16 | 只看该作者
这个长度设置在哪个范围内？没有高手指点一下吗

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11#
 楼主| 发表于 2017-3-6 15:31 | 只看该作者
gdli 发表于 2017-3-6 15:28. K3 }  n) t. ^
CLK长度1810MIL，地址线=1810+-200mil也就是1610-2010的设置范围，可是组内等长10mil，这个地址线的组内 ...
8 Y/ ~4 n: \' t* _+ X
是不是设置在2010+-10mil呢
6 ]/ l! ]3 W& [  d5 B& _

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12#
 楼主| 发表于 2017-3-6 16:15 | 只看该作者
gdli 发表于 2017-3-6 14:59
: ?( f+ `6 L# k* o1 ]这个长度设置在哪个范围呢

9 r  g2 U: x+ p2 Y) H1 _1 U# |具体是这个要求，长度设置范围怎么定9 O0 J$ K% O: J

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土豆你个马铃薯
你这个地址线直接+-50就好了  详情 回复 发表于 2017-3-6 16:20

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13#
发表于 2017-3-6 16:20 | 只看该作者
gdli 发表于 2017-3-6 16:15
* K4 q  V( t/ v/ v" M5 z6 m. c具体是这个要求，长度设置范围怎么定

! A/ h3 n1 b" z! w% b/ o你这个地址线直接+-50就好了( u# |5 r/ u4 Q/ n/ a8 s0 }

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14#
 楼主| 发表于 2017-3-6 16:21 | 只看该作者
范围怎么设置？3 @8 l/ f! O/ V' Y- Z% Q1 n

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土豆你个马铃薯
所有的地址线放一组，直接0：50，也可以直接：100，都可以  详情 回复 发表于 2017-3-6 16:25

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发表于 2017-3-6 16:25 | 只看该作者
gdli 发表于 2017-3-6 16:21# A' g  D9 j; i$ X+ b2 F
范围怎么设置？

+ n) X3 K8 R# E) |  y$ E! s4 J  f所有的地址线放一组，直接0：50，也可以直接：100，都可以
3 |* W1 g8 v( \

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gdli
那可以设置成最大地址线=1810-100=1700这样，  详情 回复 发表于 2017-3-6 16:43

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