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allegro针对BGA布线能不能按照内侧外侧扇出走线？

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mengzhuhao
  • TA的每日心情
    擦汗
    2020-1-14 15:59

    • 签到天数: 1 天

    [LV.1]初来乍到
    跳转到指定楼层
    1#
    发表于 2015-8-24 00:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    allegro针对BGA布线能不能按照内侧外侧扇出走线？* A. w$ |, @. i! O2 t
    7 q# }; ?3 m4 E
    就是在扇出过孔以后，规划内层布线，能不能指定层自动走出BGA所在区域？4 o# B8 i! ]3 X% T: s

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    2#
    发表于 2015-8-24 14:48 | 只看该作者
    研究一下FSP功能吧，有什么心得也跟大家分享一下。

    点评

    mengzhuhao
    [attachimg]101099[/attachimg] 有时候拉出来的bundle 在优化的总是存在交叉，不知道怎么才能正确交换  详情 回复 发表于 2015-8-24 21:41
    mengzhuhao
    bundle有无好的导入导出与编辑的方法？默认在规则管理器里面好像导不出来，导出的规则好像导入的时候不能把bundle导入进去？  详情 回复 发表于 2015-8-24 21:03
    mengzhuhao
    看过一些简单的bundle的介绍 但是还是有点摸不清头脑 例如我在两边的器件只拉出一小段走线 自动优化的时候发现总找不到最佳顺的方式，存在交叉（目标一侧的IO按理说是可以任意交换，如果器件的一侧规划处最少  详情 回复 发表于 2015-8-24 18:41
    mengzhuhao
    bundle的自动brake out both ends感觉也不是很好，有时候出来的结果都是乱七八糟的饶线 所以还是希望BGA除了自动扇出via后，能指定层进行自动扇出一段走线可能在规划的时候效果更好一些，也可以规划布线在哪些比  详情 回复 发表于 2015-8-24 18:37
    mengzhuhao
    我在研究FSP，但是也看了文档表述 FSP只能作为初级布局；未考虑走线因素 如果以后的版本可以直接有扇出走线因素可以添加进去的话，优化的结果会更好一些 我现在用的也不是很熟悉 我也是先在FSP里面进行预优  详情 回复 发表于 2015-8-24 18:34

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    mengzhuhao
  • TA的每日心情
    擦汗
    2020-1-14 15:59

    • 签到天数: 1 天

    [LV.1]初来乍到
    3#
     楼主| 发表于 2015-8-24 18:34 | 只看该作者
    dzkcool 发表于 2015-8-24 14:48
    & i. K$ u+ c- p5 ~9 f) H研究一下FSP功能吧，有什么心得也跟大家分享一下。
    2 u6 n' q2 W! Z8 B3 S# h
    我在研究FSP，但是也看了文档表述 FSP只能作为初级布局；未考虑走线因素4 k1 x- S3 q6 V+ W% i& _

    1 K- i8 K3 ?/ l+ W$ ?) ^如果以后的版本可以直接有扇出走线因素可以添加进去的话，优化的结果会更好一些
    3 T! ]% `1 ~0 e5 F2 w- n0 j6 C" e7 z7 z
    我现在用的也不是很熟悉$ u$ @  U1 Y& L7 k4 S' s
    7 S$ Q, S  _, |; m1 E& v( e
    我也是先在FSP里面进行预优化，然后导入进allegro里面，还需要手动添加bundle（FSP里面的group也不能自动加载上，如果能就方便了多，不知道以后能不能改进这个，将group自动变成bundle？）7 I3 V* R, d, U  D# [% l
    4 `4 d" |; N  l! d: r: W5 U
    在bundle规划出线的时候感觉 结果有时候还不是很好" L: [  S. B/ Z& [# Q2 C
    ' I$ }8 x6 z9 M" E
    有时候需要自己手动拉出线 而且要把两边的线拉近的时候 使用自动FSP交换管脚才能得到相当好的结果，有时候也存在交叉线（明显的我已经将两边的线拉顺了，但是发现有的可以顺有的没有顺，不是很清楚在操作上还有那些经验可以参考？）
    : W2 X7 a0 D) J) v  N" V* h2 {: C5 |+ ~" y
    在对bundle特性约束的时候，我就指定它只能布线在那个层，然后选择minDRC（不知道这个选择对不对），其他的好像也没啥可以选择的, O" M- P2 e& n

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    mengzhuhao
  • TA的每日心情
    擦汗
    2020-1-14 15:59

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    [LV.1]初来乍到
    4#
     楼主| 发表于 2015-8-24 18:37 | 只看该作者
    dzkcool 发表于 2015-8-24 14:487 ~, }4 }* y6 o) h) @$ C4 |+ ^3 j; q6 y
    研究一下FSP功能吧，有什么心得也跟大家分享一下。
      ?. n7 t- m( I# ^* O" e2 y& p
    bundle的自动brake out both ends感觉也不是很好，有时候出来的结果都是乱七八糟的饶线
    $ _; g- }0 F* Z' m# C2 E7 u6 G" z0 u; v) j' u- N$ O
    所以还是希望BGA除了自动扇出via后，能指定层进行自动扇出一段走线可能在规划的时候效果更好一些，也可以规划布线在哪些比较好
    5 E5 N5 {, U' l( y! s; N3 h1 ]5 e8 Y' a

    & l  O( {3 @+ J这方面经验不足，不知道大家在用allegro规划布线与布局的时候有哪些经验？
    ; C! O) @6 b& T# J% s/ x

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    mengzhuhao
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    5#
     楼主| 发表于 2015-8-24 18:41 | 只看该作者
    dzkcool 发表于 2015-8-24 14:48
    : t0 B: S2 _9 {* L研究一下FSP功能吧，有什么心得也跟大家分享一下。
    6 _9 z8 N; Q; a1 a- t, Z- R
    看过一些简单的bundle的介绍- j0 Z3 J1 g" Z6 \+ R: {5 h! ~
    但是还是有点摸不清头脑
    ) r. ^: J/ [; b3 A; Q, J! L% D& [( {5 k! k9 p4 ]9 E  X! B7 g* l: i
    例如我在两边的器件只拉出一小段走线$ _7 A8 v; l) a
    , Z0 x& c' A' ^
    自动优化的时候发现总找不到最佳顺的方式，存在交叉（目标一侧的IO按理说是可以任意交换，如果器件的一侧规划处最少通孔的走线，如果能自动优化走顺的话就是最好的结果）; p6 J3 u! Q% |0 C0 B+ X( q

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    6#
     楼主| 发表于 2015-8-24 18:45 | 只看该作者
    或者如果FSP里面直接支持bundle规划就更好了

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    mengzhuhao
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     楼主| 发表于 2015-8-24 21:03 | 只看该作者
    dzkcool 发表于 2015-8-24 14:48
    % ^$ m2 o; r; p. q. ^( D* C8 v研究一下FSP功能吧，有什么心得也跟大家分享一下。
    3 M( d0 O( G; O) a7 e, s
    bundle有无好的导入导出与编辑的方法？默认在规则管理器里面好像导不出来，导出的规则好像导入的时候不能把bundle导入进去？
    ( u5 ]4 h# Z: O. i4 m& g6 X( N* f3 K2 `# e& E# i8 h, x& e* K

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    8#
     楼主| 发表于 2015-8-24 21:41 | 只看该作者
    dzkcool 发表于 2015-8-24 14:48, V! P( i3 T# W
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    8 @: f3 o9 r( V' \* T; u! K
    8 U- I2 r" b# p
    - {4 l; I3 `" k5 @' v有时候拉出来的bundle 在优化的总是存在交叉，不知道怎么才能正确交换
    ( l' L1 L1 A( U

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    ly06341112

    该用户从未签到
    9#
    发表于 2016-2-22 15:27 | 只看该作者
    请问什么是FSP 功能，我现在正在寻求BGA扇出，怎么扇出后各引脚引线都自动拉出来

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