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[Cadence Sigrity] d老师第十一讲 PCIE power si AC耦合电容前面4个net 是怎么加到一个net下面的(P3E_...

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发表于 2020-6-20 19:39 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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杜老师第十一讲 PCIE power si AC耦合电容前面4个net 是怎么加到一个net下面的(P3E_CPU_TX0)的? 不然就需要前后net 合并才能出插损曲线。
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    发表于 2020-6-20 23:04 | 只看该作者
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    3#
    发表于 2020-6-21 13:13 | 只看该作者
    将差分属性去掉,再同时选中电容前后的网络,用merger合并,合并完再定义成差分

    “来自电巢APP”

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    4#
     楼主| 发表于 2020-6-21 22:17 | 只看该作者
    dzkcool 发表于 2020-06-21 13:13:57
    , z% C0 y) E- z  j  I  ?# [3 j将差分属性去掉,再同时选中电容前后的网络,用merger合并,合并完再定义成差分
    1 L: R+ p; d& C4 g. ^

    / U; T1 s# `6 x. p这种merge我知道 视频这种电容前后net总共4个net在一个net下面怎么操作的
    , z0 p3 D3 p, J! Y$ S: P! j4 s2 R
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    5#
    发表于 2020-6-21 22:41 来自手机 | 只看该作者
    新建一个信号名,把net拖进去就好了

    该用户从未签到

    6#
     楼主| 发表于 2020-6-23 22:06 | 只看该作者
    dzkcool 发表于 2020-06-21 22:41:58) w; c/ O5 c+ \+ R3 K' o8 a. R9 F- m' P
    新建一个信号名,把net拖进去就好了
    % P: v7 B3 O0 A( v  F
    + o1 I. y/ P1 b( ]
    可以了
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