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PADS如何考虑芯片内的芯片内部 pin delay?

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1#
发表于 2013-6-20 10:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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allegro是可以的,pads可以吗?

该用户从未签到

2#
发表于 2013-6-20 11:31 | 只看该作者
速率低于3.125G的。可以忽略pin delay.; q" ~- e+ S& W
" c3 Y" \& s4 e
另外,pads实现不了

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3#
 楼主| 发表于 2013-6-21 14:02 | 只看该作者
jimmy 发表于 2013-6-20 11:31 * i& I* t( I$ ^3 J- V% H5 g
速率低于3.125G的。可以忽略pin delay.0 d" N9 y/ S" m
; ~' T7 S4 Q8 b
另外,pads实现不了

# w8 j/ l5 x3 e那考虑芯片内部走线长度和芯片内部 pin delay是一回事吗?
5 w; v" ^3 h* j, }! ?有个产品要求做等长的信号要考虑BGA芯片内不的布线长度(厂家提供长度)

点评

是一回事。等长数据时就把厂家提供的pin delay长度加上。比如总长度1500mil,某根网络的pin delay是130,那你只需要绕1500-130就可以了。  发表于 2013-6-22 13:17
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