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verify design 检查错误?

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1#
发表于 2012-9-12 22:06 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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  N; Q$ H. C$ I" I/ J5 r1 s
( f7 F0 F9 j: E: e
- T" J1 B5 S7 B, G; m- N
8 ?: o* H6 Y- J  怎么老是出现这错误?

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2#
发表于 2012-9-12 22:58 | 只看该作者
这是进行什么检查?

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3#
 楼主| 发表于 2012-9-12 23:09 | 只看该作者
chenlinfeng88 发表于 2012-9-12 22:58 6 I  v  _+ z! ~4 [
这是进行什么检查?

5 Q( f5 b' c3 Q& a1 K0 v是对clearance检查!

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4#
发表于 2012-9-13 16:28 | 只看该作者
电性器件跟板框的间距有错误
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