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标题: 有用ECO To PCB 从原理图导PCB的请进 [打印本页]
作者: abtreasure    时间: 2012-9-8 13:18
标题: 有用ECO To PCB 从原理图导PCB的请进
PADS Logic上有一个电容元件CAPACITOR,里面设了两个PCB封装：3216和6032C，如图一
8 G, q* b( h# }5 j& ^& X
( s3 l" U/ z. P$ N某张原理图用到了两个CAPACITOR元件，其中一个元件C181将PCB封装设为3216，另一个C108设为6032C，如图二、三! f2 g. ^& F3 T0 B, H

1 |- N5 C3 X- s; t生成网表，可以找到两个PCB封装指定语句：. u! A) i* |& I4 e9 `
C181    CAPACITOR@3216  f  Z- |- {3 B2 E0 m
C108    CAPACITOR@6032C
6 I1 y4 K/ P% \$ o8 A1 D) O& l在PCB上导入这个网表，生成的两个元件封装完全正确：一个是3216，另一个是6032C
( {+ [+ \0 a3 ~- x5 a6 |
2 I  W$ V3 i5 c; ^. h现在的问题是，我不用导入网表的方法新建PCB，而是用logic上的“ECO To PCB ”功能新建PCB，如下图
! E! T3 L- r% j% y 9 ]( K, L9 m# P' S3 e
生成的PCB文件两个元件的封装都是3216，另一个则需要手动去修改，如图# w' ]1 j0 ~3 i

4 I' G/ H% Z9 d! J$ B% K是ECO哪个地方设置有误导致要手动指定而不是自动生成？
作者: dali618    时间: 2012-9-8 13:43
$ U* G& z9 E- [6 V; @
不知是不是这里
作者: abtreasure    时间: 2012-9-9 11:22
谢谢楼上！ 在这个选项打上勾就可以了；$ `) b: N- f& U( h0 q+ t( \
应该PADS logic在用ECO的时候没去检查封装，而导网表则会去核对封装。
作者: kmdzzy    时间: 2012-9-11 15:36
:xuexi



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