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EDA365电子论坛网»电子社区 › 研发技术版块 › 芯片SIP|封装设计 › Wafer RDL 单线和差分阻抗怎么计算
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Wafer RDL 单线和差分阻抗怎么计算

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tencome

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1#
 楼主| 发表于 2024-2-20 10:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
请教一下大神。
+ E7 P7 K  C; Q) o: }  [$ a! u! {, t
! X" }5 r0 ?$ E) _Wafer 来料有1层PI 大约5um，   需要在表面在设计RDL 走线， 厚度是电镀铜5um+电镀镍 3um， 线宽8~10um，   走线后再涂1层PI 5um 保护线路。
% U6 a2 J- |1 v8 f: n! V7 x
% l' z+ \  c. B& g0 i这种情况下怎么计算单线和差分阻抗？ 差分阻抗线距怎么计算？   要不要参考平面？  
! w' M4 L+ R* z3 [! P* W8 P; C- Q# B+ V, R, j
SI9000好像不支持这种Wafer RDL的计算。
: I/ P/ h; Y/ R( \( y8 v* p$ g

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taoyulon
  • TA的每日心情
    怒
    2019-11-20 15:16

    • 签到天数: 1 天

    [LV.1]初来乍到
    2#
    发表于 2024-2-20 11:37 | 只看该作者
    而差分阻抗则是描述了两个信号线之间的相对阻抗，即差分对之间的阻抗。

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